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发明公开
基于FPGA的同态加密硬件加速器及其数据处理方法审中-公开

公开(公告)号：CN120030610A

公开(公告)日：2025-05-23

申请号：CN202510109214.0

申请日：2025-01-23

Applicant: 重庆邮电大学

Inventor： 庞宇 , 王兵兵 , 苏文鹏

IPC: G06F21/72 , G06F21/76 , G06F21/60

Abstract: 本发明公开了一种基于FPGA的同态加密硬件加速器，包括FPGA端，FPGA端包括数据传输模块、控制模块、同态加密模块、同态解密模块、数论变换模块和小变大模数转换模块；数据传输模块用于实现FPGA端与上位机之间的数据传输；控制模块用于根据加密或解密操作控制数据在各个模块之间的流向；数论变换模块用于对输入的数据进行数论变换或逆数论变换得到变换后的数据或逆数论变换后的数据；同态加密模块用于对经过变换后的数据进行加密得到密文数据；同态解密模块用于对经过变换后的数据进行解密得到明文数据；小变大模数转换模块用于将多路小位宽模数的密文数据或明文数据转换为一路大位宽模数的数据。提高了同态加解密的计算效率。

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