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公开(公告)号：CN101674175B
公开(公告)日：2013-11-27
申请号：CN200810215373.5
申请日：2008-09-11
Applicant: 财团法人工业技术研究院
Abstract: 一种利用相位选取技术的突发式时钟与数据回复电路，其包括锁相回路电路、过取样相位选取电路及延迟锁定回路电路。其中，锁相回路电路用以提供多组固定的时钟讯号，各个时钟讯号具有一时钟相位。过取样相位选取电路耦接至锁相回路电路，用以利用这些时钟讯号检测所接收的数据讯号的数据边缘，并根据此数据边缘的位置选取欲锁定的时钟相位。延迟锁定回路电路则耦接至锁相回路电路及过取样相位选取电路，用以比较数据讯号的数据相位与欲锁定的时钟相位，而控制数据讯号的数据相位延迟一延迟时间，直到其数据相位锁定至时钟相位为止。
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Patent Agency Ranking
公开(公告)号：CN101997485B
公开(公告)日：2013-05-15
申请号：CN200910166420.6
申请日：2009-08-12
Applicant: 财团法人工业技术研究院
IPC: H03B7/06
Abstract: 本发明公开了一种压控振荡器，包括压控电流源、负电阻电路、第一变压器、第二变压器、第一晶体管以及第二晶体管。压控电流源的控制端接收控制电压。负电阻电路中第一与第二电流路径的第一端耦接至压控电流源的电流端。第一与第二变压器的一次侧分别耦接至负电阻电路中第一与第二电流路径的第二端。第一与第二变压器的二次侧分别作为压控振荡器的第一与第二输出端。第一与第二晶体管的第一端分别耦接至第一与第二变压器的二次侧。第一与第二晶体管的控制端分别耦接至第一与第二变压器的一次侧。
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公开(公告)号：CN102170266A
公开(公告)日：2011-08-31
申请号：CN201010125975.9
申请日：2010-02-25
Applicant: 财团法人工业技术研究院
IPC: H03B19/06
Abstract: 本发明是一种倍频器，用于对一正相振荡信号与一反相振荡信号进行处理，以于输出端产生更高频的信号。该倍频器包括一第一、一第二晶体管与一第一、一第二电感。第一与第二晶体管的第一端处于共电位。上述正相与反相振荡信号分别由第一与第二晶体管的控制端输入该倍频器。上述第一与第二电感分别将第一与第二晶体管的第二端耦接至该倍频器的输出端。第一与第二电感可用各自独立的电感元件实现，也可由具有互感效应的一对称型电感实现。
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公开(公告)号：CN102170266B
公开(公告)日：2013-04-10
申请号：CN201010125975.9
申请日：2010-02-25
Applicant: 财团法人工业技术研究院
IPC: H03B19/06
Abstract: 本发明是一种倍频器，用于对一正相振荡信号与一反相振荡信号进行处理，以于输出端产生更高频的信号。该倍频器包括一第一、一第二晶体管与一第一、一第二电感。第一与第二晶体管的第一端处于共电位。上述正相与反相振荡信号分别由第一与第二晶体管的控制端输入该倍频器。上述第一与第二电感分别将第一与第二晶体管的第二端耦接至该倍频器的输出端。第一与第二电感可用各自独立的电感元件实现，也可由具有互感效应的一对称型电感实现。
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公开(公告)号：CN101997485A
公开(公告)日：2011-03-30
申请号：CN200910166420.6
申请日：2009-08-12
Applicant: 财团法人工业技术研究院
IPC: H03B7/06
Abstract: 本发明公开了一种压控振荡器，包括压控电流源、负电阻电路、第一变压器、第二变压器、第一晶体管以及第二晶体管。压控电流源的控制端接收控制电压。负电阻电路中第一与第二电流路径的第一端耦接至压控电流源的电流端。第一与第二变压器的一次侧分别耦接至负电阻电路中第一与第二电流路径的第二端。第一与第二变压器的二次侧分别作为压控振荡器的第一与第二输出端。第一与第二晶体管的第一端分别耦接至第一与第二变压器的二次侧。第一与第二晶体管的控制端分别耦接至第一与第二变压器的一次侧。
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公开(公告)号：CN101674175A
公开(公告)日：2010-03-17
申请号：CN200810215373.5
申请日：2008-09-11
Applicant: 财团法人工业技术研究院
Abstract: 一种利用相位选取技术的突发式时钟与数据回复电路，其包括锁相回路电路、过取样相位选取电路及延迟锁定回路电路。其中，锁相回路电路用以提供多组固定的时钟讯号，各个时钟讯号具有一时钟相位。过取样相位选取电路耦接至锁相回路电路，用以利用这些时钟讯号检测所接收的数据讯号的数据边缘，并根据此数据边缘的位置选取欲锁定的时钟相位。延迟锁定回路电路则耦接至锁相回路电路及过取样相位选取电路，用以比较数据讯号的数据相位与欲锁定的时钟相位，而控制数据讯号的数据相位延迟一延迟时间，直到其数据相位锁定至时钟相位为止。
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