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公开(公告)号：CN108449090B
公开(公告)日：2020-06-16
申请号：CN201810072942.9
申请日：2018-01-25
Applicant: 西安电子科技大学
Abstract: 一种可配置多码长、多码率的低密度奇偶校验码LDPC译码器，该译码器包括三层结构，顶层模块包括存储输入软信息单元，存储输出软信息单元，存储校验和单元，译码控制单元，宏定义单元，核心译码单元；核心译码层模块包括初始化单元，迭代控制单元，变量信息处理单元VPU，校验信息处理单元CPU，迭代信息存储单元，行逻辑连接单元，列逻辑连接单元，校验单元；校验层模块包括校验核心单元，校验和计算单元。该译码器可实现对多种码长、多种码率进行灵活配置，并且能够提高译码器的吞吐率，适用于完成对多种码长、多种码率的低密度奇偶校验码LDPC的译码工作。
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公开(公告)号：CN108512619B
公开(公告)日：2020-04-14
申请号：CN201810056412.5
申请日：2018-01-21
Applicant: 西安电子科技大学
IPC: H04B17/391
Abstract: 本发明公开一种短波多通道多带宽信道的模拟方法，其步骤包括：(1)输入特征数据；(2)输入模拟信号；(3)对模拟信号采样；(4)获得解析信号；(5)获得平均功率；(6)判断平均功率是否大于噪声门限；(7)获得加频偏信号；(8)设置路径数目；(9)获得多径延时信号；(10)获得总衰落信号；(11)获得各通道信噪比；(12)获得加噪声信号；(13)获得输出信号。本发明可模拟多种信道特性，能自主判断是否有有效信号输入，且具有能够模拟在不同频段内信噪比不同的情况的优点，适用于各种短波通信实验。
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公开(公告)号：CN108449090A
公开(公告)日：2018-08-24
申请号：CN201810072942.9
申请日：2018-01-25
Applicant: 西安电子科技大学
Abstract: 一种可配置多码长、多码率的低密度奇偶校验码LDPC译码器，该译码器包括三层结构，顶层模块包括存储输入软信息单元，存储输出软信息单元，存储校验和单元，译码控制单元，宏定义单元，核心译码单元；核心译码层模块包括初始化单元，迭代控制单元，变量信息处理单元VPU，校验信息处理单元CPU，迭代信息存储单元，行逻辑连接单元，列逻辑连接单元，校验单元；校验层模块包括校验核心单元，校验和计算单元。该译码器可实现对多种码长、多种码率进行灵活配置，并且能够提高译码器的吞吐率，适用于完成对多种码长、多种码率的低密度奇偶校验码LDPC的译码工作。
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公开(公告)号：CN108512619A
公开(公告)日：2018-09-07
申请号：CN201810056412.5
申请日：2018-01-21
Applicant: 西安电子科技大学
IPC: H04B17/391
Abstract: 本发明公开一种短波多通道多带宽信道的模拟方法，其步骤包括：(1)输入特征数据；(2)输入模拟信号；(3)对模拟信号采样；(4)获得解析信号；(5)获得平均功率；(6)判断平均功率是否大于噪声门限；(7)获得加频偏信号；(8)设置路径数目；(9)获得多径延时信号；(10)获得总衰落信号；(11)获得各通道信噪比；(12)获得加噪声信号；(13)获得输出信号。本发明可模拟多种信道特性，能自主判断是否有有效信号输入，且具有能够模拟在不同频段内信噪比不同的情况的优点，适用于各种短波通信实验。
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