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公开(公告)号：CN112631959A
公开(公告)日：2021-04-09
申请号：CN202011585316.3
申请日：2019-04-04
Applicant: 英特尔公司
IPC: G06F12/0877 , G06F12/0815
Abstract: 系统、方法和设备可以包括链路层逻辑，该链路层逻辑用于：由链路层设备识别以第一协议格式从存储器接收的第一数据，由链路层设备识别以第二协议格式从高速缓存接收的第二数据，由链路层设备复用第一数据的部分和第二数据的部分以产生复用数据；以及由链路层设备生成包括复用数据的流控制单元(flit)。
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公开(公告)号：CN115152193A
公开(公告)日：2022-10-04
申请号：CN202080095639.6
申请日：2020-11-18
Applicant: 英特尔公司
Inventor： A·斯里尼瓦桑 , M·穆思乐 , A·阿勒马尼亚 , R·佩纳兰达塞布赖恩
IPC: H04L47/11 , H04L49/111
Abstract: 针对IP路由的数据中心网络使用自适应路由和基于拥塞提示的节流来改进端到端拥塞反应的方法以及相关联的装置。关于在耦合到一个或多个网络的发送和接收端点之间转发数据包，一个或多个网络交换机被配置为检测当前或接近的拥塞状况，生成拥塞通知数据包(CNP)，并将CNP返回给发送端点。可以使用一个或多个自适应路由机制来路由CNP，以沿着非拥塞路径转发CNP，或者可以沿着最快路径将CNP转发给发送方。CNP还可以包括元数据，该元数据包括与从端点发送的数据包相关联的流标识符、针对流的拥塞级别和时间戳。
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公开(公告)号：CN112631959B
公开(公告)日：2024-09-03
申请号：CN202011585316.3
申请日：2019-04-04
Applicant: 英特尔公司
IPC: G06F12/0877 , G06F12/0815
Abstract: 系统、方法和设备可以包括链路层逻辑，该链路层逻辑用于：由链路层设备识别以第一协议格式从存储器接收的第一数据，由链路层设备识别以第二协议格式从高速缓存接收的第二数据，由链路层设备复用第一数据的部分和第二数据的部分以产生复用数据；以及由链路层设备生成包括复用数据的流控制单元(flit)。
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公开(公告)号：CN115494905A
公开(公告)日：2022-12-20
申请号：CN202210546858.2
申请日：2022-05-18
Applicant: 英特尔公司
IPC: G05F1/56
Abstract: 一种电路系统包括第一电压调节器电路，所述第一电压调节器电路基于第一控制信号生成用于集成电路管芯的第一电源电压。所述第一电压调节器电路基于所述第一电源电压生成第一反馈信号。所述电路系统还包括第二电压调节器电路，其基于第二控制信号生成用于集成电路管芯的第二电源电压。所述第二电压调节器电路基于所述第二电源电压生成第二反馈信号。所述电路系统还包括第三电压调节器电路，其基于所述第一反馈信号生成所述第一控制信号，并基于所述第二反馈信号生成所述第二控制信号。所述电路系统可以包括完全集成的、板上和封装上电压调节器电路。
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Patent Agency Ranking
公开(公告)号：CN112395239A
公开(公告)日：2021-02-23
申请号：CN202010591821.2
申请日：2020-06-24
Applicant: 英特尔公司
IPC: G06F15/173 , H04L12/24 , H04L12/865
Abstract: 用于远程直接存储器访问(RDMA)网络中基于时延的服务级别协议(SLA)管理的技术包括经由网络交换机进行通信的多个计算设备。计算设备确定指示针对RDMA会话的RDMA请求中的一定百分比的保证的最大时延的服务级别目标(SLO)。计算设备从主机设备接收指示RDMA请求的时延的时延数据。计算设备根据SLO和时延数据来确定与RDMA请求相关联的优先级。计算设备基于优先级调度RDMA请求。网络交换机可以基于优先级将队列资源分配给RDMA请求，在调度RDMA请求之后收回队列资源，并且然后将队列资源返回到空闲池。描述并要求保护其他实施例。
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公开(公告)号：CN115589226A
公开(公告)日：2023-01-10
申请号：CN202210558750.5
申请日：2022-05-20
Applicant: 英特尔公司
IPC: H03K19/177 , H03K19/17758 , H01L25/18
Abstract: 一种三维电路系统包括第一和第二集成电路(IC)管芯。第一IC管芯包括布置在扇区中的可编程逻辑电路和具有第一路由器电路的第一可编程互连电路。第二IC管芯包括布置在区域中的不可编程电路和具有第二路由器电路的第二可编程互连电路。第二IC管芯中的每个区域与第一IC管芯中的至少一个扇区垂直对准。每个第二路由器电路通过垂直管芯到管芯连接耦接到第一路由器电路中的一个。第一和第二可编程互连电路可编程以通过第一和第二路由器电路在可编程逻辑电路和不可编程电路之间路由信号。电路系统可以包括附加IC管芯。第一和第二IC管芯以及任何附加IC管芯以垂直堆叠配置耦接。
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公开(公告)号：CN115498995A
公开(公告)日：2022-12-20
申请号：CN202210523286.6
申请日：2022-05-13
Applicant: 英特尔公司
IPC: H03K19/17748 , H03K19/1778 , H01L25/18
Abstract: 一种电路系统包括第一集成电路管芯，该第一集成电路管芯具有被配置为执行第一组操作的第一电路组。该电路系统还包括具有第二电路组的第二集成电路管芯，该第二电路组被配置为在第一电路组开始执行第一组操作之后以延迟开始执行第二组操作以减小电源电压下降。由第一和第二电路组执行的操作可以以固定或可变延迟交织。基于逻辑电路的预测开关活动，可以将逻辑电路划分为第一电路组和第二电路组。集成电路管芯中的去耦电容器可以耦合在一起，以在高电流事件期间减小电源电压的下降。
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公开(公告)号：CN110442534A
公开(公告)日：2019-11-12
申请号：CN201910271381.X
申请日：2019-04-04
Applicant: 英特尔公司
IPC: G06F12/0877 , G06F12/0815
Abstract: 系统、方法和设备可以包括链路层逻辑，该链路层逻辑用于：由链路层设备识别以第一协议格式从存储器接收的第一数据，由链路层设备识别以第二协议格式从高速缓存接收的第二数据，由链路层设备复用第一数据的部分和第二数据的部分以产生复用数据；以及由链路层设备生成包括复用数据的流控制单元(flit)。
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公开(公告)号：CN114253329A
公开(公告)日：2022-03-29
申请号：CN202110972633.9
申请日：2021-08-24
Applicant: 英特尔公司
IPC: G05F1/56
Abstract: 电子系统包括第一、第二、第三和第四集成电路管芯。第三集成电路管芯具有第一电压调节器电路。第一电压调节器电路的电源电压输出被耦合以向第一集成电路管芯的电源电压输入提供第一电源电压。第一电压调节器电路产生指示第一电源电压何时达到第一阈值电压的第一电源就绪信号。第四集成电路管芯具有响应于第一电源就绪信号而产生第二电源电压的第二电压调节器电路。第二电压调节器电路的电源电压输出被耦合以向第二集成电路管芯的电源电压输入提供第二电源电压。
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