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公开(公告)号：CN119652697A
公开(公告)日：2025-03-18
申请号：CN202411281945.5
申请日：2024-09-13
Applicant: 美国亚德诺半导体公司
IPC: H04L12/417 , H04L12/44 , H04L12/46
Abstract: 本公开涉及同步通信网络上的以太网帧通信。一种通信系统，包括经由相应的总线链路以菊花链连接的多个节点。多个节点被配置为通过总线链路进行全双工同步通信，以在总线链路上的超帧的灵活有效载荷内传输以太网帧。节点被配置为：确定该节点具有传输令牌；在全双工总线链路上的隧道内，在朝向主节点的上游方向或朝向末端子节点的下游方向中的至少一个方向上传输以太网帧；在传输以太网帧的同时，在与以太网帧相反的方向上，从隧道中至少一个全双工总线链路上的一个或多个其他节点接收对传输令牌的请求；并基于一个或多个其他节点的优先级顺序将传输令牌传输到下一个节点。
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公开(公告)号：CN105119794A
公开(公告)日：2015-12-02
申请号：CN201510565868.0
申请日：2012-10-05
Applicant: 美国亚德诺半导体公司
Inventor： M·凯斯勒
IPC: H04L12/40 , H04L12/403 , H04B3/54 , G06F13/42
CPC classification number: G06F11/0754 , G06F9/4411 , G06F11/221 , G06F13/364 , G06F13/4282 , G06F13/4295 , G06F2213/0016 , H04B3/548 , H04B3/56 , H04B2203/5445 , H04B2203/547 , H04B2203/5483 , H04L12/40019 , H04L12/40026 , H04L12/40045 , H04L12/403 , H04L12/4035 , H04L2012/40273 , Y02B70/123 , Y02B70/126 , Y02D10/14 , Y02D10/151
Abstract: 本发明涉及用于高速数据和电力分配的双线通信系统。本发明的各种实施例提供了简单的(例如，在从设备中不需要微控制器)、与嵌入式时钟信息同步的、便宜的、汽车EMC兼容的并且具有用于大量从设备/外围设备的足够的速度和带宽的双线(例如，非屏蔽双绞线)总线系统，并且还提供了可以用于各种通信系统(例如双线总线系统)的各种协议。双线总线可选地可以是自供电的，即，主设备可以在双线总线上为从设备提供电力。本发明方法的各种实施例用于发现、配置以及协调通信系统中的电子设备与从设备之间的数据通信。尽管参考双线点对点总线系统对示例性实施例进行描述，但是方法还可以用于其它通信系统。包括了用于控制总线和从设备的顺序供电的规定。
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公开(公告)号：CN104283584A
公开(公告)日：2015-01-14
申请号：CN201410323230.1
申请日：2014-07-08
Applicant: 美国亚德诺半导体公司
CPC classification number: G06F1/263 , G06F1/266 , G06F1/28 , G06F13/4256
Abstract: 在示例实施例中，一种在双向、多节点的双线导体系统中提供自动音频总线(A2B)芯片的功率开关电路，所述双线导体系统包括在双绞线总线(A2B总线)上互连的多个A2B芯片，其中至少一个A2B芯片作为主节点，以及其余的A2B芯片作为从节点。A2B芯片的功率开关电路根据功率开关过程对A2B总线中的下一个下游A2B芯片顺序地加电，以及所述功率开关电路经配置以在功率开关过程之前、期间和之后检测A2B总线中的故障。每个A2B芯片使能大堆下个下游A2B芯片的功率，而不因为下游A2B总线的故障而危害系统中的任何组件，或破坏在局部A2B芯片的功率供应。
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公开(公告)号：CN119790386A
公开(公告)日：2025-04-08
申请号：CN202380062890.6
申请日：2023-07-01
Applicant: 美国亚德诺半导体公司
Inventor： M·凯斯勒
Abstract: 网络包括节点(102‑1、102‑2)。节点(102‑1,102‑2)包括主节点MN(102‑1)和多个子节点SNi＝SN0,...SNX(102‑2)。每个节点(102‑1,102‑2)包括可操作用于根据第一网络协议执行数据通信的节点收发器(120)。每个节点收发器(120)包括可操作用于为所述节点收发器(120)供电以执行所述数据通信的正电源触点V+(122)和负电源触点V‑(124)。数据通信网络包括两导体组合的功率和数据物理层/介质(1510)。物理层将SN0 V+连接到第一导电路径(1560)中的总线电源正电源触点VS+(1520)。物理层将MN V‑和SNX V‑连接到第二导电路径(1570)中的总线电源负电源触点VS‑(1530)。对于i＝0至X‑l，物理层将每个SNi V‑1连接到第一导电路径(1560)中的SNi+1 V+。
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公开(公告)号：CN119452605A
公开(公告)日：2025-02-14
申请号：CN202380047620.8
申请日：2023-07-01
Applicant: 美国亚德诺半导体公司
Abstract: 在网络和方法的一些示例中，数据网络包括节点。节点包括主节点(MN)和至少一个子节点。每个节点包括节点收发器。节点收发器可操作用于根据第一网络协议执行数据通信，以通过第一对导体对数据进行供电。物理层包括每个节点之间的电缆段(例如总线的电缆段)。每个电缆段包括多对导体(例如，成对)和每端的连接器(例如，8P8C连接器，但也可以使用具有多对导体的其他连接器)。第一对导体(例如，连接到8P8C连接器的引脚4和引脚5)实现了节点之间的第一网络协议。剩余对导体的一个或多个为节点提供补充电力。
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Patent Agency Ranking
公开(公告)号：CN116529720A
公开(公告)日：2023-08-01
申请号：CN202180080237.3
申请日：2021-10-20
Applicant: 美国亚德诺半导体公司
Inventor： N·K·K·马德戈夫达 , M·凯斯勒
IPC: G06F15/173
Abstract: 本文公开了用于菊花链网络中的节点发现和配置的系统和技术。例如，在一些实施例中，主节点可以“自动发现”菊花链网络中的子节点的拓扑结构和身份，使得拓扑结构的变化可以容易地适应，而不会对网络中的数据传输造成实质性的中断。
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公开(公告)号：CN107025200B
公开(公告)日：2021-03-12
申请号：CN201710056872.3
申请日：2017-01-26
Applicant: 美国亚德诺半导体公司
IPC: G06F13/40
Abstract: 本公开涉及多节点链接网络上的GPIO到GPIO通信。本文公开了用于多节点菊花链网络中的通用输入/输出(GPIO)到GPIO通信的系统和技术。在一些实施例中，收发器可以支持在多个节点之间的GPIO，而在初始编程之后没有主机干预。在一些这样的实施例中，可以仅需要主机用于虚拟端口的初始设置。在一些实施例中，GPIO引脚可以是输入(其可以改变虚拟端口)或输出(其可以反映虚拟端口)。在一些实施例中，多个虚拟端口可以被映射到一个GPIO输出引脚(例如，将值OR在一起)。在一些实施例中，多个GPIO输入引脚可以被映射到一个虚拟端口。例如，多个GPIO输入引脚值可以被OR运算在一起，即使它们来自多个节点。
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公开(公告)号：CN107025200A
公开(公告)日：2017-08-08
申请号：CN201710056872.3
申请日：2017-01-26
Applicant: 美国亚德诺半导体公司
IPC: G06F13/40
Abstract: 本公开涉及多节点链接网络上的GPIO到GPIO通信。本文公开了用于多节点菊花链网络中的通用输入/输出(GPIO)到GPIO通信的系统和技术。在一些实施例中，收发器可以支持在多个节点之间的GPIO，而在初始编程之后没有主机干预。在一些这样的实施例中，可以仅需要主机用于虚拟端口的初始设置。在一些实施例中，GPIO引脚可以是输入(其可以改变虚拟端口)或输出(其可以反映虚拟端口)。在一些实施例中，多个虚拟端口可以被映射到一个GPIO输出引脚(例如，将值OR在一起)。在一些实施例中，多个GPIO输入引脚可以被映射到一个虚拟端口。例如，多个GPIO输入引脚值可以被OR运算在一起，即使它们来自多个节点。
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公开(公告)号：CN106878125A
公开(公告)日：2017-06-20
申请号：CN201610898937.4
申请日：2016-10-14
Applicant: 美国亚德诺半导体公司
IPC: H04L12/40
CPC classification number: G06F13/426 , G05B19/0421 , G05B19/0423 , G05B19/4185 , G06F1/26 , G06F13/364 , G06F13/4282 , G06F13/4291 , G06F13/4295 , H04B3/542 , H04B3/548 , H04B2203/547 , H04L12/4035 , H04R29/007 , Y02D10/14 , Y02D10/151 , H04L12/40182 , H04L12/40019 , H04L12/40045
Abstract: 本文所公开的是双线通信系统及其应用。在一些实施例中，低延迟通信的从节点收发器可以包括上游收发器电路，以接收通过双线总线从上游设备发送的第一信号，并在双线总线向上游设备提供第二信号；下游收发器电路，经过双线总线向下游设备下游提供第三信号，并经过双线总线从下游设备接收第四信号；以及时钟电路，以基于述第一信号中的同步控制帧的前导码产生在从节点收发器的时钟信号，其中，由节点收发器经过双线总线接收和提供信号的时序是基于时钟信号。
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公开(公告)号：CN104303521B
公开(公告)日：2017-04-26
申请号：CN201480001253.9
申请日：2014-01-22
Applicant: 奥迪股份公司 , 美国亚德诺半导体公司
CPC classification number: H04R1/08 , H04R3/00 , H04R19/005 , H04R2201/003 , H04R2499/13
Abstract: 本发明涉及一种用于在机动车(10)中采集声音的麦克风(18)，该麦克风具有：麦克风罩(32)，该麦克风罩具有至少一个声音输入开口(34)；在麦克风罩(32)中设置的麦克风膜；在麦克风罩(32)中设置的、用于根据麦克风膜的运动产生单个电膜信号的驱动电路(38)。能够从麦克风罩(32)外部触及地设置的并且与麦克风罩(32)相连的连接触点(42)输出电麦克风信号。本发明的目的在于提供一种用于在机动车中采集声音的麦克风布置结构，该麦克风布置结构仅需要少量结构空间。为此同样在麦克风罩(32)中设置接口电路(40)，该接口电路设计为用于将驱动电路(38)的单个膜信号直接转换为根据预定的总线标准的数字总线信号，并且将该总线信号作为麦克风信号通过连接触点(42)输出到数据总线(28)。
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