可配置外设输入输出引脚的延迟补偿方法和相关产品

    公开(公告)号:CN120034175A

    公开(公告)日:2025-05-23

    申请号:CN202411929202.4

    申请日:2024-12-25

    Inventor: 刘文峰 陈伟男

    Abstract: 本发明实施例提供了一种可配置外设输入输出引脚的延迟补偿方法和相关产品,该方法包括:输入输出延迟调整电路检测当前是否存在针对可配置外设输入输出引脚的延迟补偿需求;在可配置外设输入输出引脚存在延迟补偿需求时,输入输出延迟调整电路调整可配置外设输入输出引脚的延迟。通过本发明实施例,可以通过输入输出延迟调整电路来对可配置外设输入输出引脚的延迟进行调整,从而既能保证用户电路板走线设计的灵活性,又能提高与高速外设进行数据通信的可靠性。

    一种检测电路、检测方法、装置、电子设备及存储介质

    公开(公告)号:CN117388678A

    公开(公告)日:2024-01-12

    申请号:CN202311249428.5

    申请日:2023-09-25

    Abstract: 本发明提供了一种检测电路、检测方法、装置、电子设备及存储介质,该检测电路包括:第一输入端、第二输入端、电压检测电路和电压输出端;电压检测电路包括电流镜电路;第一输入端与按键连接,按键处于被触摸状态时,第一输入端与第二输入端形成电压差;电流镜电路,用于复制电流以从电压输出端中输出检测电压。其中,所要输出的检测电压为第一输入端与第二输入端形成的电压差。通过采用上述方法,实现对触摸按键进行是否触摸检测,输出两个输入端的电压差值,检测电路简单、占用面积小,且电流镜使得输出电阻增大了本征增益倍,可以使得电流更加稳定,检测结果具有更高的准确性。

    多层神经网络的计算方法、装置、设备及计算机可读介质

    公开(公告)号:CN114548354A

    公开(公告)日:2022-05-27

    申请号:CN202011348888.X

    申请日:2020-11-26

    Inventor: 刘文峰

    Abstract: 本申请涉及一种多层神经网络的计算方法、装置、设备及计算机可读介质。该方法包括:将目标神经网络各个网络层的中间数据保存在边缘缓冲区,中间数据为各个网络层相邻输入分割区域之间的重叠部分进行计算得到的数据,边缘缓冲区为用于缓存中间数据的区域;装载目标网络层的输入数据至神经网络处理器时,从边缘缓冲区将中间数据装载至神经网络处理器,以利用神经网络处理器对目标网络层进行计算。本申请采用在每层网络层输入区域增补输入补边区域,可以使得多层卷积神经网络运算没有重复计算,并且增补的少量中间数据保存在边缘缓冲区,大大降低了内存带宽压力,从而解决了多层神经网络计算效率低的技术问题。

    集成电路的版图设计方法、装置、设备和介质

    公开(公告)号:CN119026551A

    公开(公告)日:2024-11-26

    申请号:CN202410951380.0

    申请日:2024-07-16

    Abstract: 本发明实施例提供了一种集成电路的版图设计方法、装置、设备和存储介质,本发明可以通过在数据库中查询用户选择的工艺类型对应的初始保护环掩膜层间距,再预设算法对初始保护环掩膜层间距进行优化,从而根据优化后的保护环掩膜层间距生成集成电路的版图;本发明通过使用预设数据库来确定保护环掩膜层间距,由于预先在数据库中保存了不同工艺类型对应的保护环掩膜层间距,可以确保不同设计项目和不同设计师之间的一致性,减少因个人经验差异导致的设计偏差;本发明通过预设算法对初始保护环掩膜层间距进行优化,可以确保保护环的设计更加精确地满足电气性能要求。

    虚拟定时器的扩展方法、装置、电子装置及存储介质

    公开(公告)号:CN116149784A

    公开(公告)日:2023-05-23

    申请号:CN202211643519.2

    申请日:2022-12-20

    Inventor: 刘文峰

    Abstract: 本申请涉及一种虚拟定时器的扩展方法、装置、电子装置及存储介质,该方法包括:获取预设的多个扩展通道所对应通道参数,通道参数包括每个扩展通道的通道状态、通道数据和对应的通道触发时刻;根据通道状态,在多个扩展通道中选定目标虚拟通道,每个扩展通道关联一个虚拟定时器,虚拟定时器用于处理预设的用户配置;在目标虚拟通道对应的通道触发时刻,基于目标虚拟通道对应的通道数据和通道状态,对目标虚拟通道进行参数切换,以使目标虚拟通道对应的虚拟定时器处理对应的用户配置。通过本申请,解决了采用每个定时器配置IP核,会增大芯片面积、浪费资源及增加设计成本的问题,实现根据需要扩展定时器数量,减小定时器IP核数量,节约芯片面积的有益效果。

    光栅操作电路、装置、显示控制系统及显示装置

    公开(公告)号:CN114153409A

    公开(公告)日:2022-03-08

    申请号:CN202111436487.4

    申请日:2021-11-26

    Abstract: 本发明提出一种光栅操作电路、装置、显示控制系统及显示装置,光栅操作电路包括解码模块以及计算模块;解码模块的输入端以及计算模块的输入端分别为光栅操作电路的输入端,解码模块与计算模块连接,计算模块的输出端作为光栅操作电路的输出端;其中:解码模块,用于接收光栅操作码,对光栅操作进行解码得到像素计算数据,并将像素计算数据发送至计算模块;计算模块,用于接收图像像素数据,并对图像像素数据进行与像素计算数据对应的光栅操作得到像素结果值,并输出像素结果值。通过构建光栅操作电路,使得能够直接通过硬件电路对图像像素数据进行光栅操作,避免了占用CPU资源,从而使得能够提高对于图像处理的效率。

    一种芯片的获取方法、装置、电子设备、存储介质及芯片

    公开(公告)号:CN118824844A

    公开(公告)日:2024-10-22

    申请号:CN202410821126.9

    申请日:2024-06-24

    Abstract: 本申请公开了一种芯片的获取方法、装置、电子设备、存储介质及芯片,涉及芯片技术领域,通过在晶圆上,使用第一掩膜板对第二芯片的第二电路层进行光刻操作,并使用预设的第二掩膜板对第二芯片的第三电路层进行光刻操作,以获得第一处理后晶圆,再将第一处理后晶圆进行切割,获得多个第一晶圆单元,并对第一晶圆单元进行封装,获得第二芯片,在此过程中,由于第二芯片的获取复用了第一芯片的第一电路层使用的第一掩膜板,即第二芯片和第一芯片共用第一掩膜板,与在先技术中每种类型的芯片均具有对应的一套掩膜板相比,减少了部分类型的芯片的掩膜板的数量,从而降低了芯片的生产成本。

    一种卷积神经网络的高效编码方法、设备、存储介质

    公开(公告)号:CN114332258B

    公开(公告)日:2024-09-13

    申请号:CN202111585121.3

    申请日:2021-12-22

    Inventor: 刘文峰

    Abstract: 一种卷积神经网络的高效编码方法,包括以下步骤:以卷积神经网络进行计算首帧图像,选择并保存中间层的特定行列数据作为参考卷积;后续每一帧图像当计算完成第一层卷积时,与参考卷积比较,将变化小或不变的多个通道卷积结果输出进行游程编码;根据游程编码区域和非游程编码区域输入数据时,取出相应中间层的特定行列数据以执行不同策略的卷积运算;每隔预设帧数图像时更新参考卷积。本发明大大减少了在NPU和存储器之间导入导出中间层数据对传输带宽的需求,能够有效减少卷积神经网络对静态图像区域的重复计算,提高神经网络的计算速度,达到实时响应的要求,同时功耗大大降低。

    一种混合虚拟设备的构建方法和装置

    公开(公告)号:CN117908668A

    公开(公告)日:2024-04-19

    申请号:CN202311799980.1

    申请日:2023-12-25

    Inventor: 刘文峰

    Abstract: 本发明实施例提供了一种混合虚拟设备的构建方法和装置,通过确定数据源类型,并基于所述数据源类型确定起点输入输出模块;确定功能模块;确定输出数据类型,并基于所述输出数据类型确定终点输入输出模块;采用所述起点输入输出模块、功能模块和所述终点输入输出模块生成多个独立虚拟设备;采用多个所述独立虚拟设备构建混合虚拟设备,使虚拟设备实现芯片上特定设备功能,缩减设备冗余。

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