延时计算电路、芯片运行频率获取方法、装置及电子设备

    公开(公告)号:CN112667024A

    公开(公告)日:2021-04-16

    申请号:CN202011623520.X

    申请日:2020-12-31

    Inventor: 刘勋 魏洁 陈佰儒

    Abstract: 本申请涉及一种延时计算电路、芯片运行频率获取方法、装置及电子设备。延时计算电路包括选择控制模块、行波计数器和多个振荡信号生成模块,多个振荡信号生成模块用于与目标芯片中包括的多条目标关键路径一一对应连接。多个振荡信号生成模块中,每个振荡信号生成模块用于在对应的目标关键路径的延时作用下生成振荡信号。选择控制模块用于分别选取出多个振荡信号生成模块中的每个振荡信号生成模块所生成的振荡信号,并发送给行波计数器。行波计数器用于对接收到的每条振荡信号进行计数,以获得多个振荡信号生成模块中,每个振荡信号生成模块所生成的振荡信号在目标计数时长内的信号计数值。延时计算电路能够降低获得目标芯片整体运行频率的难度。

    集成电路、跨时钟域的数据传输方法、电子设备、存储介质

    公开(公告)号:CN119847283A

    公开(公告)日:2025-04-18

    申请号:CN202411930853.5

    申请日:2024-12-25

    Inventor: 陈佰儒 张倬 刘勋

    Abstract: 一种集成电路、跨时钟域的数据传输方法、电子设备、存储介质。该集成电路包括第一时钟域和第二时钟域,第一时钟域包括第一指针控制模块,第二时钟域包括第二指针控制模块,第一指针控制模块包括第一同步指针控制模块,第一同步指针控制模块配置为:响应于第一时钟信号的频率大于第二时钟信号的频率,根据第二时钟域的第二时钟相位和第二时钟周期、第一时钟信号、第一时钟域的第一时钟相位,确定第一时钟信号和第二时钟信号的相位关系,并基于相位关系确定第一指针控制信号;响应于第一时钟信号的频率小于第二时钟信号的频率,确定第一指针控制信号为第一值,以使得第一读指针和第一写指针在第一时钟信号的各个时钟周期增加第一值。

    延时计算电路、芯片运行频率获取方法、装置及电子设备

    公开(公告)号:CN112667024B

    公开(公告)日:2023-10-20

    申请号:CN202011623520.X

    申请日:2020-12-31

    Inventor: 刘勋 魏洁 陈佰儒

    Abstract: 本申请涉及一种延时计算电路、芯片运行频率获取方法、装置及电子设备。延时计算电路包括选择控制模块、行波计数器和多个振荡信号生成模块,多个振荡信号生成模块用于与目标芯片中包括的多条目标关键路径一一对应连接。多个振荡信号生成模块中,每个振荡信号生成模块用于在对应的目标关键路径的延时作用下生成振荡信号。选择控制模块用于分别选取出多个振荡信号生成模块中的每个振荡信号生成模块所生成的振荡信号,并发送给行波计数器。行波计数器用于对接收到的每条振荡信号进行计数,以获得多个振荡信号生成模块中,每个振荡信号生成模块所生成的振荡信号在目标计数时长内的信号计数值。延时计算电路能够降低获得目标芯片整体运行频率的难度。

    指针同步装置及方法、异步FIFO电路、处理器系统

    公开(公告)号:CN111949582B

    公开(公告)日:2022-01-18

    申请号:CN202010866691.9

    申请日:2020-08-25

    Inventor: 陈佰儒 刘勋

    Abstract: 本申请提供一种指针同步装置及方法、异步FIFO电路、处理器系统,包括存储器、写索引逻辑模块和读索引逻辑模块,写索引逻辑模块的时钟周期为快时钟周期,读索引逻辑模块的时钟周期为慢时钟周期;写索引逻辑模块根据快时钟周期和慢时钟周期确定写入时刻,并在写入时刻向存储器写入第一指针;读索引逻辑模块根据慢时钟周期,从存储器中读取第一指针;其中,写入时刻满足:使得同一第一指针从被写入存储器到被从存储器读出的时间差为第一目标延迟时间。写入时刻的确定令同一第一指针从被写入到被读出的时间差为第一目标延迟时间,短于现有技术中的延迟时间,从而可以满足高性能处理器对数据传输的低延迟的需求。

    芯粒以及芯粒的控制方法

    公开(公告)号:CN116414212B

    公开(公告)日:2024-02-13

    申请号:CN202310397447.6

    申请日:2023-04-13

    Inventor: 陈佰儒 刘勋

    Abstract: 本公开涉及一种芯粒及芯粒的控制方法。该芯粒包括物理层功能模块和第一物理层接口模块,物理层功能模块包括发送状态机子模块、数据报文发送子模块和控制报文发送子模块。数据报文发送子模块配置为提供第一数据报文,控制报文发送子模块配置为提供第一状态进入报文,发送状态机子模块配置为控制物理层功能模块由向第一物理层接口模块提供第一数据报文切换为向第一物理层接口模块提供第一状态进入报文,使第一物理层接口模块由通过物理链路向另一芯粒提供第一数据报文切换为通过物理链路向另一芯粒提供第一状态进入报文,以及控制第一物理层接口模块由工作状态进入低功耗状态。该芯片不需要使用额外的管脚来控制第一物理层接口模块进入低功耗状态。

    芯粒以及芯粒的控制方法

    公开(公告)号:CN116414212A

    公开(公告)日:2023-07-11

    申请号:CN202310397447.6

    申请日:2023-04-13

    Inventor: 陈佰儒 刘勋

    Abstract: 本公开涉及一种芯粒及芯粒的控制方法。该芯粒包括物理层功能模块和第一物理层接口模块,物理层功能模块包括发送状态机子模块、数据报文发送子模块和控制报文发送子模块。数据报文发送子模块配置为提供第一数据报文,控制报文发送子模块配置为提供第一状态进入报文,发送状态机子模块配置为控制物理层功能模块由向第一物理层接口模块提供第一数据报文切换为向第一物理层接口模块提供第一状态进入报文,使第一物理层接口模块由通过物理链路向另一芯粒提供第一数据报文切换为通过物理链路向另一芯粒提供第一状态进入报文,以及控制第一物理层接口模块由工作状态进入低功耗状态。该芯片不需要使用额外的管脚来控制第一物理层接口模块进入低功耗状态。

    功耗监测系统、相关方法、装置、处理器及介质

    公开(公告)号:CN112559282A

    公开(公告)日:2021-03-26

    申请号:CN202011420661.1

    申请日:2020-12-08

    Inventor: 陈佰儒 刘勋

    Abstract: 本申请实施例中的功耗监测系统、相关方法、装置、处理器及介质,功耗监测系统包括:对应功能模块设置的至少一事件监测模块,用于监测所述功能模块的至少一待监测硬件事件的发生情况,以得到事件统计参数;控制模块,耦接所述至少一事件监测模块,用于根据所述至少一个功能模块的事件统计参数计算所述集成电路的动态功耗。本申请实施例中的功耗监测系统,通过对应集成电路的各个功能模块配置事件监测模块,以监测功能模块的待监测硬件事件的发生情况而形成事件统计参数,并由计算与之对应的动态功耗,以能监测到全面精准的动态功耗。

    芯片动态功耗估计方法、装置、处理器芯片及服务器

    公开(公告)号:CN112416709B

    公开(公告)日:2023-03-21

    申请号:CN202011307004.6

    申请日:2020-11-19

    Abstract: 本发明实施例公开了一种芯片动态功耗估计方法、装置、处理器芯片及服务器,种芯片动态功耗估计方法,包括:获取芯片的测试用例;根据所述测试用例得到仿真波形;获取第一信号集;确定所述第一信号集中的各信号在所述仿真波形中的跳变情况;根据所述跳变情况从所述第一信号集中剔除部分信号,得到第二信号集;根据所述第二信号集中信号之间的相似性剔除所述第二信号集中部分相似的信号,得到第三信号集;剔除所述第三信号集中的噪声信号,得到目标信号集;基于所述目标信号集中的信号对所述芯片的各模块的动态功耗进行估计,该方法可提高芯片动态功耗估计的精度。

    芯片动态功耗估计方法、装置、处理器芯片及服务器

    公开(公告)号:CN112416709A

    公开(公告)日:2021-02-26

    申请号:CN202011307004.6

    申请日:2020-11-19

    Abstract: 本发明实施例公开了一种芯片动态功耗估计方法、装置、处理器芯片及服务器,种芯片动态功耗估计方法,包括:获取芯片的测试用例;根据所述测试用例得到仿真波形;获取第一信号集;确定所述第一信号集中的各信号在所述仿真波形中的跳变情况;根据所述跳变情况从所述第一信号集中剔除部分信号,得到第二信号集;根据所述第二信号集中信号之间的相似性剔除所述第二信号集中部分相似的信号,得到第三信号集;剔除所述第三信号集中的噪声信号,得到目标信号集;基于所述目标信号集中的信号对所述芯片的各模块的动态功耗进行估计,该方法可提高芯片动态功耗估计的精度。

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