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Patent Agency Ranking
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公开(公告)号：CN103310850B
公开(公告)日：2016-01-20
申请号：CN201310261284.5
申请日：2013-06-27
Applicant: 桂林电子科技大学
IPC: G11C29/12
Abstract: 本发明为片上网络资源节点存储器的内建自测试结构和自测试方法，本内建自测试结构包括建立于FPGA芯片的BIST控制器，还有嵌于相应路由器的资源网络接口和BIST接口、测试图形生成器和测试响应分析器。BIST控制器经外设接口和外部测试设备连接。本方法为：外部测试设备向BIST控制器发送指令启动测试程序；BIST控制器按照March C+测试算法程序向各测试模块发送使能信号和状态选择信号，在每个测试状态下对SRAM各地址进行读写操作，发现故障立即停止。测试结果发送给外部测试设备。本发明测试时间减少一半，复用NoC的路由网络作为测试数据路径，数据传输可靠安全，芯片面积开销小；故障覆盖率较高。
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公开(公告)号：CN103412849A
公开(公告)日：2013-11-27
申请号：CN201310334500.4
申请日：2013-08-02
Applicant: 桂林电子科技大学
IPC: G06F15/173
Abstract: 本发明为ARM处理器的NoC资源网络接口及其驱动方法，本ARM处理器的NoC资源网络接口ARM-RNI，包括建立于FPGA中的AHB总线接口处理模块、发送和接收模块，经数据总线直接与ARM处理器的AHB总线连接。ARM中有Linux系统及其FPGA的设备驱动程序。ARM-RNI与路由节点相连接。本驱动方法为初始化后，发送、接收模块的输入、输出缓冲器的物理地址映射到ARM内核，ARM发送的数据经ARM-RNI的发送模块传送到当地路由节点，片上网络转发的的数据经ARM-RNI的接收模块传送到ARM。本发明实现ARM与FPGA稳定高速的数据通信，减少了FPGA资源的使用，NoC可用功能强大的ARM、拓展其应用，增强NoC的扩展能力和网络通信能力。
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公开(公告)号：CN103310850A
公开(公告)日：2013-09-18
申请号：CN201310261284.5
申请日：2013-06-27
Applicant: 桂林电子科技大学
IPC: G11C29/12
Abstract: 本发明为片上网络资源节点存储器的内建自测试结构和自测试方法，本内建自测试结构包括建立于FPGA芯片的BIST控制器，还有嵌于相应路由器的资源网络接口和BIST接口、测试图形生成器和测试响应分析器。BIST控制器经外设接口和外部测试设备连接。本方法为：外部测试设备向BIST控制器发送指令启动测试程序；BIST控制器按照March C+测试算法程序向各测试模块发送使能信号和状态选择信号，在每个测试状态下对SRAM各地址进行读写操作，发现故障立即停止。测试结果发送给外部测试设备。本发明测试时间减少一半，复用NoC的路由网络作为测试数据路径，数据传输可靠安全，芯片面积开销小；故障覆盖率较高。
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