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公开(公告)号：CN1148697B
公开(公告)日：2010-06-09
申请号：CN96112121.1
申请日：1996-07-27
Applicant: 株式会社日立制作所
CPC classification number: H04N9/64 , G09G5/18 , H03L7/081 , H03L7/091 , H03L7/199 , H04N5/04 , H04N5/126 , H04N5/20
Abstract: 在视频信号处理装置中将试验图形视频信号V0转换成8位数据，并与写入控制电路5中产生的取样时钟同步，然后存储在存储器中。MPU9读出该视频信号的有效区域中的象素数据，并计算其值大于预定值的白电平象素数据的平均值和小于预定值的黑电平象素数据的平均值之间的差AT，以及白电平象素数据和黑电平象素数据之间的总变化VT。MPU9控制在写入控制电路5中产生的取样时钟的相位使AT为最大而VT为最小。
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公开(公告)号：CN101202032A
公开(公告)日：2008-06-18
申请号：CN200710108600.X
申请日：2007-06-08
Applicant: 株式会社日立制作所
CPC classification number: G06F3/1446 , G09G3/2096 , G09G5/008
Abstract: 本发明提供电路规模小且构成简单，可无限制地数字链连接图像显示装置的多屏显示装置和其所使用的数字链电路。在本发明中，将像素时钟(107)用作数字接口发射电路(2)的像素时钟，其中该像素时钟(107)由移相器(5)输出，该移相器(5)与通过数字接口接收电路(1)将由PLL4生成的像素时钟再现而得到的数字图像信号(101)的数据相位一致。
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公开(公告)号：CN101202032B
公开(公告)日：2011-01-05
申请号：CN200710108600.X
申请日：2007-06-08
Applicant: 株式会社日立制作所
CPC classification number: G06F3/1446 , G09G3/2096 , G09G5/008
Abstract: 本发明提供电路规模小且构成简单，可无限制地数字链连接图像显示装置的多屏显示装置和其所使用的数字链电路。在本发明中，将像素时钟(107)用作数字接口发射电路(2)的像素时钟，其中该像素时钟(107)由移相器(5)输出，该移相器(5)与通过数字接口接收电路(1)将由PLL4生成的像素时钟再现而得到的数字图像信号(101)的数据相位一致。
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公开(公告)号：CN1148697A
公开(公告)日：1997-04-30
申请号：CN96112121.1
申请日：1996-07-27
Applicant: 株式会社日立制作所
CPC classification number: H04N9/64 , G09G5/18 , H03L7/081 , H03L7/091 , H03L7/199 , H04N5/04 , H04N5/126 , H04N5/20
Abstract: 在视频信号处理装置中将试验图形视频信号V0转换成8位数据，并与写入控制电路5中产生的取样时钟同步，然后存储在存储器中。MPU9读出该视频信号的有效区域中的象素数据，并计算其值大于预定值的白电平象素数据的平均值和小于预定值的黑电平象素数据的平均值之间的差AT，以及白电平象素数据和黑电平象素数据之间的总变化VT。MPU9控制在写入控制电路5中产生的取样时钟的相位使AT为最大而VT为最小。
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