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公开(公告)号：CN102624654A
公开(公告)日：2012-08-01
申请号：CN201210018672.6
申请日：2012-01-20
Applicant: 株式会社日立制作所
Inventor： 村冈谕
CPC classification number: H04L25/03878 , H04B3/04 , H05K1/0233 , H05K1/0251 , H05K2201/086
Abstract: 本发明提供一种不对每个电路变更所安装的部件就能够与传输路径的特性配合地对电路的频率特性进行平滑化的消耗功率低的传输电路。本发明的传输电路基板具备具有与信号传输线并联的电感的无源均衡器，利用形成在电路基板的贯通孔侧面的导体部分构成电感。
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公开(公告)号：CN105027092B
公开(公告)日：2018-01-30
申请号：CN201380069806.X
申请日：2013-03-27
Applicant: 株式会社日立制作所
Inventor： 植松裕 , 村冈谕 , 大坂英树 , 柴田正文 , 福村裕佑 , 渡边聪 , 柿田宏 , 出居昭男 , 上野仁 , 尾野孝之 , 宫川贵志 , 内藤伦典 , 隅仓大志 , 福田裕一
CPC classification number: G06F3/068 , G06F3/0611 , G06F3/0629 , G06F13/1694 , G11C5/04 , G11C7/10
Abstract: 在将作为高速存储器的DRAM和作为比DRAM低速但却是能够大容量化的非易失性存储器的闪存搭载于DIMM时，为了使CPU存储器总线处理量最大化，而部件配置就会成为问题。因此，本公开的存储器模块(DIMM)将存储器控制器配置于靠近插口端子一侧，将作为高速存储器的DRAM配置于其背面。将作为大容量存储器的闪存配置于远离插口端子的一侧。
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公开(公告)号：CN102624654B
公开(公告)日：2016-02-03
申请号：CN201210018672.6
申请日：2012-01-20
Applicant: 株式会社日立制作所
Inventor： 村冈谕
CPC classification number: H04L25/03878 , H04B3/04 , H05K1/0233 , H05K1/0251 , H05K2201/086
Abstract: 本发明提供一种不对每个电路变更所安装的部件就能够与传输路径的特性配合地对电路的频率特性进行平滑化的消耗功率低的传输电路。本发明的传输电路基板具备具有与信号传输线并联的电感的无源均衡器，利用形成在电路基板的贯通孔侧面的导体部分构成电感。
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公开(公告)号：CN105027092A
公开(公告)日：2015-11-04
申请号：CN201380069806.X
申请日：2013-03-27
Applicant: 株式会社日立制作所
Inventor： 植松裕 , 村冈谕 , 大坂英树 , 柴田正文 , 福村裕佑 , 渡边聪 , 柿田宏 , 出居昭男 , 上野仁 , 尾野孝之 , 宫川贵志 , 内藤伦典 , 隅仓大志 , 福田裕一
CPC classification number: G06F3/068 , G06F3/0611 , G06F3/0629 , G06F13/1694 , G11C5/04 , G11C7/10
Abstract: 在将作为高速存储器的DRAM和作为比DRAM低速但却是能够大容量化的非易失性存储器的闪存搭载于DIMM时，为了使CPU存储器总线处理量最大化，而部件配置就会成为问题。因此，本公开的存储器模块(DIMM)将存储器控制器配置于靠近插口端子一侧，将作为高速存储器的DRAM配置于其背面。将作为大容量存储器的闪存配置于远离插口端子的一侧。
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