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公开(公告)号：CN101377910A
公开(公告)日：2009-03-04
申请号：CN200810213080.3
申请日：2008-08-28
Applicant: 株式会社东芝
CPC classification number: G09G3/3648 , G09G2320/0252 , G09G2320/0261 , G09G2320/0285 , G09G2340/16
Abstract: 本发明提供一种画质的劣化少且电路规模尽可能小的液晶驱动装置以及液晶显示装置。该液晶驱动装置具备：存储部，存储在将n设为3或4、将m设为0以上小于2n的整数时小数点以下为(1/2n)×m的强调校正系数；帧存储器(2)，保持第1帧的1帧前的第2帧的数字的图像信息；第1运算部(41)，运算出第1帧的数字的图像信息与第2帧的数字的图像信息之差；第2运算部(42)，根据差和强调校正系数，运算出用于在液晶面板上对图像进行强调显示的强调图像信息；第3运算部(43)，向强调图像信息加上第2帧的数字的图像信息而运算出加法信息；以及驱动信号生成部(6)，根据加法信息生成对液晶面板进行驱动的驱动信号。
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公开(公告)号：CN100429694C
公开(公告)日：2008-10-29
申请号：CN200580000276.9
申请日：2005-09-21
Applicant: 株式会社东芝
CPC classification number: G06F3/1415 , G09G3/2096 , G09G3/3688 , G09G5/006 , G09G5/008 , G09G2310/027 , G09G2330/06 , G09G2340/16 , G09G2370/045 , G09G2370/047
Abstract: 一种图像数据处理设备，包括：将算术图像数据划分为对应于显示设备的信号线的算术像素数据的数据划分单元；将第一数据和第二数据相加的加法器；以及延迟相加的数据的数据延迟单元，其中，第一数据是来自数据划分单元的已划分的算术像素数据，第二数据是来自数据延迟单元的延迟的相加的算术像素数据。
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公开(公告)号：CN1402425A
公开(公告)日：2003-03-12
申请号：CN02142043.2
申请日：2002-08-23
Applicant: 株式会社东芝
IPC: H03F3/45
CPC classification number: H03F3/211 , G09G3/3614 , G09G2310/027 , H03F1/0277 , H03F2203/45371 , H03F2203/7236 , H03K5/2481
Abstract: 本发明提供一种可充分扩大差动输入信号的共模电压动态范围的差动放大电路。该差动放大电路具备：由NMOS晶体管(M1、M2)构成的第1差动对；由NMOS晶体管(M3、M4)构成的第2差动对；向所述第1及第2差动对供给电流的电流源(I1)；切换控制第2差动对是否工作的差动对控制电路，差动对控制电路具有：连接在来自电流源I1的电流流过NMOS晶体管(M3、M4)的电流路径上的NMOS晶体管(M5、M6)；控制NMOS晶体管(M5、M6)的栅极电压的电平变换电路。当输入IN的电压低时，仅使第2差动对动作，当输入IN的电压高时，仅使第1差动对动作，故能够扩大差动输入信号的共模电压的动态范围。
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公开(公告)号：CN100339883C
公开(公告)日：2007-09-26
申请号：CN200410031464.5
申请日：2001-09-20
Applicant: 株式会社东芝
CPC classification number: G09G3/3696 , G09G3/2011 , G09G3/3688 , G09G2310/027 , G09G2330/021 , G09G2360/16
Abstract: 本发明具有移位寄存器(1)、数据锁存电路(2)、负载锁存电路(3)、电平移位器(4)、译码器(21)、输出选择电路(22)、分压器(7)和缓冲放大器(6)。根据灰度数切换放大器启动电路(25)内的触发电路和数据锁存电路(2)中的锁存部的驱动数，所以，不需要的触发电路等就不消耗电力，从而可以降低功耗。另外，缓冲放大器(6)由2级结构的放大器构成，在缓冲放大器(6)的输出端子与各负载之间分别串联连接了电阻和开关。这样，即使负载量变化，时间常数也一定，从而稳定时间缩短，可以稳定地动作。
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公开(公告)号：CN1193336C
公开(公告)日：2005-03-16
申请号：CN01140667.4
申请日：2001-09-20
Applicant: 株式会社东芝
IPC: G09G3/36
CPC classification number: G09G3/3696 , G09G3/2011 , G09G3/3688 , G09G2310/027 , G09G2330/021 , G09G2360/16
Abstract: 本发明具有移位寄存器1、数据锁存电路2、负载锁存电路3、电平移位器4、译码器21、输出选择电路22、分压器7和缓冲放大器6。根据灰度数切换放大器启动电路25内的触发电路和数据锁存电路2中的锁存部的驱动数，所以，不需要的触发电路等就不消耗电力，从而可以降低功耗。另外，缓冲放大器6由2级结构的放大器构成，在缓冲放大器6的输出端子与各负载之间分别串联连接了电阻和开关。这样，即使负载量变化，时间常数也一定，从而稳定时间缩短，可以稳定地动作。
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Patent Agency Ranking
公开(公告)号：CN1348167A
公开(公告)日：2002-05-08
申请号：CN01140667.4
申请日：2001-09-20
Applicant: 株式会社东芝
IPC: G09G3/36
CPC classification number: G09G3/3696 , G09G3/2011 , G09G3/3688 , G09G2310/027 , G09G2330/021 , G09G2360/16
Abstract: 本发明具有移位寄存器1、数据锁存电路2、负载锁存电路3、电平移位器4、译码器21、输出选择电路22、分压器7和缓冲放大器6。根据灰度数切换放大器启动电路25内的触发电路和数据锁存电路2中的锁存部的驱动数,所以,不需要的触发电路等就不消耗电力,从而可以降低功耗。另外,缓冲放大器6由2级结构的放大器构成,在缓冲放大器6的输出端子与各负载之间分别串联连接了电阻和开关。这样,即使负载量变化,时间常数也一定,从而稳定时间缩短,可以稳定地动作。
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公开(公告)号：CN101083065A
公开(公告)日：2007-12-05
申请号：CN200710108166.5
申请日：2007-05-30
Applicant: 株式会社东芝
Abstract: 本发明能够显示提高画质后的动态图像。液晶显示装置(30)中，设置了帧存储器(1)、修正数据生成电路(2)、源极驱动器(3)、栅极驱动器(4)和显示面板(5)。修正数据生成电路(2)中设置了减法器(11)、α乘法器(12)和加法器(13)。减法器(11)输入从帧存储器(1)中输出的前1帧的图像数据L0和当前帧的图像数据L1，进行减法处理。α乘法器(12)输入从减法器(11)中输出的信号，进行α倍的运算处理。加法器(13)输入从帧存储器(1)中输出的前1帧的图像数据L0和从α乘法器(12)中输出的α乘法结果，进行加法处理，将过驱动后的修正图像数据LLAO向源极驱动器(3)输出。
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公开(公告)号：CN1926602A
公开(公告)日：2007-03-07
申请号：CN200580000276.9
申请日：2005-09-21
Applicant: 株式会社东芝
CPC classification number: G06F3/1415 , G09G3/2096 , G09G3/3688 , G09G5/006 , G09G5/008 , G09G2310/027 , G09G2330/06 , G09G2340/16 , G09G2370/045 , G09G2370/047
Abstract: 一种图像数据处理设备，包括：将算术图像数据划分为对应于显示设备的信号线的算术像素数据的数据划分单元；将第一数据和第二数据相加的加法器；以及延迟相加的数据的数据延迟单元，其中，第一数据是来自数据划分单元的已划分的算术像素数据，第二数据是来自数据延迟单元的延迟的相加的算术像素数据。
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公开(公告)号：CN1302618C
公开(公告)日：2007-02-28
申请号：CN02142043.2
申请日：2002-08-23
Applicant: 株式会社东芝
IPC: H03F3/45
CPC classification number: H03F3/211 , G09G3/3614 , G09G2310/027 , H03F1/0277 , H03F2203/45371 , H03F2203/7236 , H03K5/2481
Abstract: 本发明提供一种可充分扩大差动输入信号的共模电压动态范围的差动放大电路。该差动放大电路具备：由NMOS晶体管(M1、M2)构成的第1差动对；由NMOS晶体管(M3、M4)构成的第2差动对；向所述第1及第2差动对供给电流的电流源(I1)；切换控制第2差动对是否工作的差动对控制电路，差动对控制电路具有：连接在来自电流源I1的电流流过NMOS晶体管(M3、M4)的电流路径上的NMOS晶体管(M5、M6)；控制NMOS晶体管(M5、M6)的栅极电压的电平变换电路。当输入IN的电压低时，仅使第2差动对动作，当输入IN的电压高时，仅使第1差动对动作，故能够扩大差动输入信号的共模电压的动态范围。
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公开(公告)号：CN1532798A
公开(公告)日：2004-09-29
申请号：CN200410031464.5
申请日：2001-09-20
Applicant: 株式会社东芝
CPC classification number: G09G3/3696 , G09G3/2011 , G09G3/3688 , G09G2310/027 , G09G2330/021 , G09G2360/16
Abstract: 本发明具有移位寄存器1、数据锁存电路2、负载锁存电路3、电平移位器4、译码器21、输出选择电路22、分压器7和缓冲放大器6。根据灰度数切换放大器启动电路25内的触发电路和数据锁存电路2中的锁存部的驱动数，所以，不需要的触发电路等就不消耗电力，从而可以降低功耗。另外，缓冲放大器6由2级结构的放大器构成，在缓冲放大器6的输出端子与各负载之间分别串联连接了电阻和开关。这样，即使负载量变化，时间常数也一定，从而稳定时间缩短，可以稳定地动作。
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