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公开(公告)号：CN1750638A
公开(公告)日：2006-03-22
申请号：CN200510113686.6
申请日：2002-03-25
Applicant: 松下电器产业株式会社 , 索尼株式会社
Abstract: 本发明提供一种能够利用DVI标准的电缆等，以简单的结构良好地进行，在视频数据上多路复用音频数据来传送的数据发送方法、数据接收方法。从数据发送侧，在使用视频消隐同步信号和像素时钟所生成的叠加定时将在视频数据的视频消隐期间叠加了音频数据的视频/音频数据叠加信号，与视频消隐同步信号和像素时钟一起，经由DVI用电缆对数据接收侧进行传送，在数据接收侧使用所传送的视频消隐同步信号和像素时钟生成从视频/音频数据叠加信号抽取音频数据的定时信号，并使用此定时信号将视频/音频数据叠加信号分离成视频数据和音频数据，同时使用对像素时钟进行分频所生成的音频时钟将数字音频数据变换成模拟音频信号。
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公开(公告)号：CN1231059C
公开(公告)日：2005-12-07
申请号：CN02807140.9
申请日：2002-03-25
Applicant: 松下电器产业株式会社 , 索尼株式会社
Abstract: 本发明提供一种能够利用DVI标准的电缆等，以简单的结构良好地进行，在视频数据上多路复用音频数据来传送的数据发送方法、数据接收方法。从数据发送侧，在使用视频消隐同步信号和像素时钟所生成的叠加定时将在视频数据的视频消隐期间叠加了音频数据的视频/音频数据叠加信号，与视频消隐同步信号和像素时钟一起，经由DVI用电缆对数据接收侧进行传送，在数据接收侧使用所传送的视频消隐同步信号和像素时钟生成从视频/音频数据叠加信号抽取音频数据的定时信号，并使用此定时信号将视频/音频数据叠加信号分离成视频数据和音频数据，同时使用对像素时钟进行分频所生成的音频时钟将数字音频数据变换成模拟音频信号。
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公开(公告)号：CN1509569A
公开(公告)日：2004-06-30
申请号：CN02807140.9
申请日：2002-03-25
Applicant: 松下电器产业株式会社 , 索尼株式会社
Abstract: 本发明提供一种能够利用DVI标准的电缆等，以简单的结构良好地进行，在视频数据上多路复用音频数据来传送的数据发送方法、数据接收方法。从数据发送侧，在使用视频消隐同步信号和像素时钟所生成的叠加定时将在视频数据的视频消隐期间叠加了音频数据的视频/音频数据叠加信号，与视频消隐同步信号和像素时钟一起，经由DVI用电缆对数据接收侧进行传送，在数据接收侧使用所传送的视频消隐同步信号和像素时钟生成从视频/音频数据叠加信号抽取音频数据的定时信号，并使用此定时信号将视频/音频数据叠加信号分离成视频数据和音频数据，同时使用对像素时钟进行分频所生成的音频时钟将数字音频数据变换成模拟音频信号。
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公开(公告)号：CN1459196A
公开(公告)日：2003-11-26
申请号：CN02800765.4
申请日：2002-01-28
Applicant: 索尼公司 , 松下电器产业株式会社
CPC classification number: H04N7/088 , H04L1/0065 , H04L1/08 , H04L25/4908 , H04L2001/0096 , H04N5/4401 , H04N5/66 , H04N7/083 , H04N9/30 , H04N11/042
Abstract: 本发明是使用作为传送信道的线路、从发送部(30)对接收部(50)传送数字视频信号的视频信号接收发送系统，发送部(30)把应该发送的视频信号变换成比构成该视频信号的像素的数据长度更长的比特串，对于不传送该比特串中的像素数据的消隐期间分配多个比特串，使用该多个比特串多次传送相同的叠加数据，接收部(50)从接收到的数据中提取表示消隐期间的特定的比特串，对于针对提取了的比特串进行了解调的结果进行多数表决，以确定输出数据，由此，减小附加数据接收的误差，简化电路结构并谋求误码率的改善。
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公开(公告)号：CN100407788C
公开(公告)日：2008-07-30
申请号：CN02800765.4
申请日：2002-01-28
Applicant: 索尼公司 , 松下电器产业株式会社
CPC classification number: H04N7/088 , H04L1/0065 , H04L1/08 , H04L25/4908 , H04L2001/0096 , H04N5/4401 , H04N5/66 , H04N7/083 , H04N9/30 , H04N11/042
Abstract: 本发明是使用作为传送信道的线路、从发送部(30)对接收部(50)传送数字视频信号的视频信号接收发送系统，发送部(30)把应该发送的视频信号变换成比构成该视频信号的像素的数据长度更长的比特串，对于不传送该比特串中的像素数据的消隐期间分配多个比特串，使用该多个比特串多次传送相同的叠加数据，接收部(50)从接收到的数据中提取表示消隐期间的特定的比特串，对于针对提取了的比特串进行了解调的结果进行多数表决，以确定输出数据，由此，减小附加数据接收的误差，简化电路结构并谋求误码率的改善。
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