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公开(公告)号:CN116964558A
公开(公告)日:2023-10-27
申请号:CN202280014865.6
申请日:2022-01-24
Applicant: 微软技术许可有限责任公司
IPC: G06F9/48
Abstract: 提供了一种活动平滑器电路来控制处理活动的变化速率,以限制IC的活动区域中的di/dt,来减轻电压下降或过冲。控制活动变化速率防止或减少di/dt超过基于IC和/或封装的物理限制的编程最大值的情况。在示例中,活动平滑器电路包括控制区域中的活动的平滑电路的层次结构,下至包括执行电路的个体电路块(分片)。期望活动水平的指示被提供给父平滑电路,并且父平滑电路以被允许发生的实际活动的指示响应。在层次结构的每个级别,活动平滑器电路可以使用算法来基于期望活动和di/dt限制的指示来生成实际活动的指示。Di/dt限制以及电流最小值和最大值被控制。
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公开(公告)号:CN117015764A
公开(公告)日:2023-11-07
申请号:CN202280020407.3
申请日:2022-03-01
Applicant: 微软技术许可有限责任公司
IPC: G06F9/52
Abstract: 一个示例提供了集成计算设备,包括一个或多个计算集群以及一个或多个网络控制器,每个网络控制器包括:本地数据通知队列,用于将源自集成计算设备上的计算集群的发送消息通知排队;远程数据通知队列,用于将源自远程集成计算设备上的网络控制器的接收消息通知排队;本地无数据通知队列,用于将来自集成计算设备上的计算集群的接收消息通知排队;以及连接调度器,被配置为在本地数据通知队列中的发送消息通知与远程数据通知队列中的接收消息通知相匹配时,对来自集成计算设备上的存储器的数据发送进行调度,并对来自本地无数据通知队列的接收消息通知的发送进行调度。
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公开(公告)号:CN110998729B
公开(公告)日:2023-08-22
申请号:CN201880039312.X
申请日:2018-05-24
Applicant: 微软技术许可有限责任公司
IPC: G11C7/10
Abstract: 提供了用于执行后台功能的与存储器集成的逻辑以及相关方法。存储器中的方法包括:响应于来自与存储器分离的主机的请求,发起后台功能的处理。方法还包括自动地监测存储器以检测需要使用存储器的多个存储单元中的至少一个存储单元或存储器的至少一个数据路径的任何标准操作是否正在被执行。方法还包括:当需要使用存储单元或存储器的数据路径的标准操作被检测到时,除非后台功能的处理仅需要作为与存储器集成的逻辑部分被提供并且被配置为仅对后台功能进行处理的资源,否则自动地挂起后台功能的处理。
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公开(公告)号:CN116490859A
公开(公告)日:2023-07-25
申请号:CN202180074316.3
申请日:2021-07-30
Applicant: 微软技术许可有限责任公司
IPC: G06F13/28
Abstract: 提供了一种计算设备,包括多个存储器设备、多个直接存储器访问(DMA)控制器和片上互连。片上互连可以被配置为实现控制逻辑,以将读取请求从多个DMA控制器中的主DMA控制器传送到多个存储器设备中的源存储器设备。片上互连还可以被配置为实现控制逻辑,以将读取响应从源存储器设备传送到多个DMA控制器中的主DMA控制器和一个或多个次DMA控制器。
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公开(公告)号:CN110998729A
公开(公告)日:2020-04-10
申请号:CN201880039312.X
申请日:2018-05-24
Applicant: 微软技术许可有限责任公司
IPC: G11C7/10
Abstract: 提供了用于执行后台功能的与存储器集成的逻辑以及相关方法。存储器中的方法包括:响应于来自与存储器分离的主机的请求,发起后台功能的处理。方法还包括自动地监测存储器以检测需要使用存储器的多个存储单元中的至少一个存储单元或存储器的至少一个数据路径的任何标准操作是否正在被执行。方法还包括:当需要使用存储单元或存储器的数据路径的标准操作被检测到时,除非后台功能的处理仅需要作为与存储器集成的逻辑部分被提供并且被配置为仅对后台功能进行处理的资源,否则自动地挂起后台功能的处理。
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公开(公告)号:CN117546146A
公开(公告)日:2024-02-09
申请号:CN202280044489.5
申请日:2022-05-13
Applicant: 微软技术许可有限责任公司
IPC: G06F9/52
Abstract: 硬件信号量被用来提高评估前提的速度。在个体基础上,每个硬件信号量都可以实现二进制信号量或计数信号量。硬件信号量的集合可以被链在一起以实现可以支持多个条件的链信号量。此外,硬件信号量不仅能够具有可以生成中断的能力,而且还能够生成命令,诸如针对其他信号量的命令。编译器可以在编译时或运行时执行跨越多个硬件信号量的链信号量的实现。集成电路芯片可以包括多个执行单元,诸如处理核,并且执行单元中的个体执行单元可以与多个硬件信号量相关联,诸如以硬件信号量阵列的形式。专用片上网络可实现硬件信号量通信。
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