一种列控系统硬件实时编码的方法及系统

    公开(公告)号:CN119928953A

    公开(公告)日:2025-05-06

    申请号:CN202510435734.0

    申请日:2025-04-09

    Abstract: 本发明涉及/属于列车控制技术领域,尤其涉及一种列控系统硬件实时编码的方法及系统。旨在解决现有技术中存在的安全性不足,缺乏足够的安全冗余设计,导致系统在故障条件下无法运行的技术问题。该方法用于FPGA中,包括:第一编码模块、第二编码模块和DPRAM模块,具体包括:对初始应答器报文进行稳定处理,得到稳定应答器报文;将稳定应答器报文分别输入两路并行的第一编码模块和第二编码模块,基于外部CPU发送的控制信号,利用第一编码模块和第二编码模块分别对稳定应答器报文进行实时编码,得到第一编码报文和第二编码报文;将第一编码报文和第二编码报文存储于DPRAM模块,用于供外部CPU进行读取。

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