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公开(公告)号：CN102790655A
公开(公告)日：2012-11-21
申请号：CN201110132522.3
申请日：2011-05-20
Applicant: 中兴通讯股份有限公司
IPC: H04L1/00
CPC classification number: H04L1/0066 , H04L1/0043
Abstract: 本发明公开了一种实现Turbo编码的装置和方法，所述装置包括：码块数据存储模块，用于接收编码块数据，并将接收的各编码块数据交替缓存在乒乓随机存取存储器RAM中；内交织处理模块，用于接收表示编码块数据大小的参数K，基于接收的各参数K，流水线计算读取各所述编码块数据所需的内交织处理的读地址；编码模块，用于基于所述内交织处理的读地址，在所述码块数据存储模块中流水线读取编码块数据，对读取的编码块数据进行编码处理后输出。本发明提供的方法和装置，通过流水线方式，增加了Turbo编码的处理效率。
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公开(公告)号：CN103580722B
公开(公告)日：2016-06-22
申请号：CN201210259593.4
申请日：2012-07-25
Applicant: 中兴通讯股份有限公司
IPC: H04B1/7117
CPC classification number: H04B1/7117 , H04B1/7103
Abstract: 本发明公开了一种上行控制信道干扰消除的装置和方法，所述装置包括：多径选择模块和上行控制信道干扰消除模块；所述多径选择模块，用于选择能量值满足预设高能量径选择条件的径作为使能径；所述上行控制信道干扰消除模块，用于对所述使能径进行重构和叠加，并进行上行控制信道的干扰消除。本方案中选取尽可能多的高能量径进行重构，高效的利用硬件重构资源，提升解调增益。
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Patent Agency Ranking
公开(公告)号：CN101674159A
公开(公告)日：2010-03-17
申请号：CN200910190657.8
申请日：2009-09-28
Applicant: 中兴通讯股份有限公司
IPC: H04L1/00
Abstract: 本发明公开了一种解速率匹配的方法和装置，所述方法包括：判断数据组是执行了打孔、执行了重复，或者无操作；对于无操作的数据组，直接输出该数据组；判断执行了操作的数据组中每个比特数据执行的操作：对于执行了打孔的数据组，判断数据组中每个比特数据是执行了打孔，或者无操作；对于执行了重复的数据组，判断数据组中每个比特数据是执行了重复，或者无操作；对于执行了打孔的比特数据，输出零；对于执行了重复的比特数据，饱和累加后输出；对于无操作的比特数据，直接输出。本发明可以减少解速率匹配时的误码率，提高解速率匹配的效率。
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公开(公告)号：CN102790655B
公开(公告)日：2015-05-20
申请号：CN201110132522.3
申请日：2011-05-20
Applicant: 中兴通讯股份有限公司
IPC: H04L1/00
CPC classification number: H04L1/0066 , H04L1/0043
Abstract: 本发明公开了一种实现Turbo编码的装置和方法，所述装置包括：码块数据存储模块，用于接收编码块数据，并将接收的各编码块数据交替缓存在乒乓随机存取存储器RAM中；内交织处理模块，用于接收表示编码块数据大小的参数K，基于接收的各参数K，流水线计算读取各所述编码块数据所需的内交织处理的读地址；编码模块，用于基于所述内交织处理的读地址，在所述码块数据存储模块中流水线读取编码块数据，对读取的编码块数据进行编码处理后输出。本发明提供的方法和装置，通过流水线方式，增加了Turbo编码的处理效率。
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公开(公告)号：CN103580722A
公开(公告)日：2014-02-12
申请号：CN201210259593.4
申请日：2012-07-25
Applicant: 中兴通讯股份有限公司
IPC: H04B1/7117
CPC classification number: H04B1/7117 , H04B1/7103
Abstract: 本发明公开了一种上行控制信道干扰消除的装置和方法，所述装置包括：多径选择模块和上行控制信道干扰消除模块；所述多径选择模块，用于选择能量值满足预设高能量径选择条件的径作为使能径；所述上行控制信道干扰消除模块，用于对所述使能径进行重构和叠加，并进行上行控制信道的干扰消除。本方案中选取尽可能多的高能量径进行重构，高效的利用硬件重构资源，提升解调增益。
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公开(公告)号：CN102236622A
公开(公告)日：2011-11-09
申请号：CN201010165385.9
申请日：2010-04-30
Applicant: 中兴通讯股份有限公司
IPC: G06F13/16
Abstract: 本发明提供一种提高动态存储器带宽利用率的动态存储器控制器及方法，该方法包括：动态存储器控制器在向动态存储器发送操作指令的同时接收并存储各访问端口的访问请求，当正在发送的操作指令发送完毕后向所述动态存储器发送存储的下一操作指令。采用本发明的技术方案，可有效解决现有技术中动态存储器带宽利用率低的技术问题。
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公开(公告)号：CN101674159B
公开(公告)日：2013-06-05
申请号：CN200910190657.8
申请日：2009-09-28
Applicant: 中兴通讯股份有限公司
IPC: H04L1/00
Abstract: 本发明公开了一种解速率匹配的方法和装置，所述方法包括：判断数据组是执行了打孔、执行了重复，或者无操作；对于无操作的数据组，直接输出该数据组；判断执行了操作的数据组中每个比特数据执行的操作：对于执行了打孔的数据组，判断数据组中每个比特数据是执行了打孔，或者无操作；对于执行了重复的数据组，判断数据组中每个比特数据是执行了重复，或者无操作；对于执行了打孔的比特数据，输出零；对于执行了重复的比特数据，饱和累加后输出；对于无操作的比特数据，直接输出。本发明可以减少解速率匹配时的误码率，提高解速率匹配的效率。
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