一种可扩展的高性能多接口星载存储系统

    公开(公告)号:CN111522513B

    公开(公告)日:2022-08-12

    申请号:CN202010336358.7

    申请日:2020-04-24

    Abstract: 本申请公开了可扩展的高性能多接口星载存储系统,包括:至少一套存储系统,存储系统包括电源模块、存储模块和网络交换模块;存储模块包括第一存储单元和第二存储单元,第一存储单元和第二存储单元分别包括一个提供标准PCIe及以太网接口的固存模块和一个提供定制接口与PCIe接口相互转换的接口模块;电源模块用于为所述存储模块和网络交换模块供电;网络交换模块用于提供可扩展及标准以太网接口。本发明利用成熟的以太网交换通信技术,提升了星载存储系统数传接口通用性同时保留了定制化设计、提高了星载存储系统的可扩展性,提升存储性能的同时保留了传统星载存储系统可靠性,对于提高星载数传系统传输速率、可扩展性及可靠性保障有着积极的借鉴意义。

    一种多机间互不干扰的多路AD采集设备

    公开(公告)号:CN109462401B

    公开(公告)日:2022-07-05

    申请号:CN201811391332.1

    申请日:2018-11-21

    Abstract: 本发明公开了一种多机间互不干扰的多路AD采集设备,可支持多路AD采集设备同时采样,每路AD采集设备均包括:输入端匹配阻容网络,用于对输入模拟量信号进行RC滤波,实现多机故障隔离;两级多路开关切换电路,用于实现外部模拟量输入通道的切换;电压跟随器,用于对多路开关输出的信号进行缓冲和隔离;AD采样电路,用于对所述电压跟随器输出的模拟信号进行多位AD转换;采样同步电路,用于协调多机采样节拍,确保采样时间的差异性;FPGA控制电路,用于对整个采样链路的时序控制,并根据硬件和软件状态,实现对采样方式的切换。本发明消除冗余设备之间、采样通道之间的相互干扰,确保每个设备采样的精确度。

    三冗余计算机时钟中断检测和同步方法及计算机系统

    公开(公告)号:CN113190082A

    公开(公告)日:2021-07-30

    申请号:CN202110588588.7

    申请日:2021-05-27

    Abstract: 本发明提供了一种三冗余计算机时钟中断检测和同步方法及计算机系统,包括:S1:控制钟源产生同步脉冲;S2:检测同步脉冲的脉冲宽度以及周期,对同步脉冲的脉宽和周期进行计数,确定同步脉冲是否在处于正常状态,且在同步脉冲处于正常状态时触发步骤S2;S3:控制每个同步脉冲进行中断产生多个周期性脉冲信号;S4:设置三个同步周期性脉冲信号的钟源选择配置寄存器,以用于存储周期性脉冲信号对应的标志位;S5:检测周期性脉冲信号的脉冲宽度,判断周期性脉冲信号是否处于正常状态,且在处于正常状态时,通过提供标志位供应用软件读取,作为应用软件选源依据。本发明能够完成三冗余计算机的软件同步问题,提高了冗余系统软件运行的同步性和可靠性。

    一种多机间互不干扰的多路AD采集设备

    公开(公告)号:CN109462401A

    公开(公告)日:2019-03-12

    申请号:CN201811391332.1

    申请日:2018-11-21

    Abstract: 本发明公开了一种多机间互不干扰的多路AD采集设备,可支持多路AD采集设备同时采样,每路AD采集设备均包括:输入端匹配阻容网络,用于对输入模拟量信号进行RC滤波,实现多机故障隔离;两级多路开关切换电路,用于实现外部模拟量输入通道的切换;电压跟随器,用于对多路开关输出的信号进行缓冲和隔离;AD采样电路,用于对所述电压跟随器输出的模拟信号进行多位AD转换;采样同步电路,用于协调多机采样节拍,确保采样时间的差异性;FPGA控制电路,用于对整个采样链路的时序控制,并根据硬件和软件状态,实现对采样方式的切换。本发明消除冗余设备之间、采样通道之间的相互干扰,确保每个设备采样的精确度。

    一种FPGA实现的AD自动采集系统

    公开(公告)号:CN108803418A

    公开(公告)日:2018-11-13

    申请号:CN201810601167.1

    申请日:2018-06-12

    CPC classification number: G05B19/042 G05B2219/24215

    Abstract: 本发明公开了一种FPGA实现的AD自动采集系统,包括CPU、FPGA、SRAM和若干A/D转换电路;若干A/D转换电路、CPU和SRAM分别与FPGA连接;SRAM用于存储采集配置表和采集数据存储表,CPU将采样配置信息存储在SRAM中,FPGA读取配置信息控制采集过程,并将若干A/D转换电路采集的结果写入SRAM中,CPU再从SRAM中读取采集的结果。本发明采用了软件动态配置实现和AD自动化采集,实现了高效的、灵活的AD采集系统。

    高可靠脉宽信号检测系统、平台及方法

    公开(公告)号:CN111413549A

    公开(公告)日:2020-07-14

    申请号:CN202010337260.3

    申请日:2020-04-26

    Abstract: 本发明提供了一种高可靠脉宽信号检测系统、平台及方法,包括:高频计数滤波模块,用于以输入信号频率的百万倍的高频时钟进行采样、计数及滤波;三模冗余锁存与判断模块,用于对滤波后的信号进行状态存储,并进行组合逻辑判断后输出;低频信号采样模块,用于以输入信号频率的百倍低频时钟,进行信号状态判断,计数有效脉宽;脉宽计数判断模块,用于对有效脉宽值进行判断,当其大于预设阈值时,判定输入信号错误,否则判为有效信号;脉宽范围判断模块,用于在判读到信号无效时进行跟踪计数,如无效电平的连续计数值在预设范围时,判定有效,将无效电平计数器清零计数,否则判为错误,将脉宽计数器清零计数。

    以处理器为核心的电路时序测量方法和装置

    公开(公告)号:CN111241764A

    公开(公告)日:2020-06-05

    申请号:CN202010000764.6

    申请日:2020-01-02

    Abstract: 本发明提供了一种以处理器为核心的电路时序测量方法和装置,该方法包括:确定以处理器为核心的电路访存关系,列出连接器件的输入输出管脚表;根据管脚表,确定信号传输链路径测量点;对路径测量点进行分析,得到信号特性列表;获得各个器件与时序相关的端点信号数据;将端点信号数据与器件手册数据比对,得到时序分析结果。本发明可以在不完全测试的情况下,将信号因传输链路造成的变性引入测量中,将测量和分析结果相结合,获得最接近于完全测量的信号,可以用于分析电路的时序是否满足器件手册的时序关系,适用于无法直接在器件管脚测量全部电路信号特性的情况。

    三冗余计算机时钟中断检测和同步方法及计算机系统

    公开(公告)号:CN113190082B

    公开(公告)日:2023-02-07

    申请号:CN202110588588.7

    申请日:2021-05-27

    Abstract: 本发明提供了一种三冗余计算机时钟中断检测和同步方法及计算机系统,包括:S1:控制钟源产生同步脉冲;S2:检测同步脉冲的脉冲宽度以及周期,对同步脉冲的脉宽和周期进行计数,确定同步脉冲是否在处于正常状态,且在同步脉冲处于正常状态时触发步骤S2;S3:控制每个同步脉冲进行中断产生多个周期性脉冲信号;S4:设置三个同步周期性脉冲信号的钟源选择配置寄存器,以用于存储周期性脉冲信号对应的标志位;S5:检测周期性脉冲信号的脉冲宽度,判断周期性脉冲信号是否处于正常状态,且在处于正常状态时,通过提供标志位供应用软件读取,作为应用软件选源依据。本发明能够完成三冗余计算机的软件同步问题,提高了冗余系统软件运行的同步性和可靠性。

    以处理器为核心的电路时序测量方法和装置

    公开(公告)号:CN111241764B

    公开(公告)日:2022-09-13

    申请号:CN202010000764.6

    申请日:2020-01-02

    Abstract: 本发明提供了一种以处理器为核心的电路时序测量方法和装置,该方法包括:确定以处理器为核心的电路访存关系,列出连接器件的输入输出管脚表;根据管脚表,确定信号传输链路径测量点;对路径测量点进行分析,得到信号特性列表;获得各个器件与时序相关的端点信号数据;将端点信号数据与器件手册数据比对,得到时序分析结果。本发明可以在不完全测试的情况下,将信号因传输链路造成的变性引入测量中,将测量和分析结果相结合,获得最接近于完全测量的信号,可以用于分析电路的时序是否满足器件手册的时序关系,适用于无法直接在器件管脚测量全部电路信号特性的情况。

    一种基于实时操作系统的星载驱动框架设计方法

    公开(公告)号:CN111651144B

    公开(公告)日:2022-07-01

    申请号:CN202010509753.0

    申请日:2020-06-05

    Abstract: 本发明公开了一种基于实时操作系统的星载驱动框架设计方法,其包括以下步骤:步骤一,针对星载外部设备进行分类;步骤二,针对每种设备的驱动定义用户级的设备结构体;步骤三,定义星载外部设备的操作接口;步骤四,将用户定义的接口与操作系统定义的结构体指针相关联;步骤五,将驱动编写编译成单独的模块,以.ko结尾,与内核实现分离;步骤六,嵌入式操作系统启动注册设备驱动,应用程序启动注册具体设备;步骤七,在操作系统之上,增加一层中间件层,统一管理设备,对外提供统一的硬件调用接口;步骤八,周期性监控每种外部设备。本发明能够将外部设备驱动模块与内核分离出来,实现解耦合,具有极大的可扩展性和便捷性。

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