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公开(公告)号：CN108111411A
公开(公告)日：2018-06-01
申请号：CN201711276678.2
申请日：2017-12-06
Applicant: 上海神添实业有限公司 , 上海无线电设备研究所
IPC: H04L12/707 , H04L12/715 , H04L12/735 , H04L12/751 , H04Q11/00
Abstract: 本发明公开一种骨干网络动态路径规划方法，该规划方法包含：根据光纤骨干网络构建基于光载波波长的分层网络拓扑；基于光载波波长的分层网络拓扑通过Bhandari算法得到源节点至目的节点的两条不相交的路径。本发明在路径发现过程中采用改进的Bhandari算法在基于光载波波长的分层网络中快速寻找到两条无交集的最优路径作为主路径与备份路径，有效避免因为链路失效带来的通信中断；节点根据自身的网络带宽需求和整个网络的资源占用情况计算出实时最优路径，并通过改进的算法在分层网络中快速查找两条互不相交的最优路径，为高速通信提供可靠路由保障，基于波分复用技术在计算物理路径的同时分配光纤中的光载波波长，算法效率高，反应速度快。
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Patent Agency Ranking
公开(公告)号：CN108111411B
公开(公告)日：2020-12-22
申请号：CN201711276678.2
申请日：2017-12-06
Applicant: 上海神添实业有限公司 , 上海无线电设备研究所
IPC: H04L12/707 , H04L12/715 , H04L12/735 , H04L12/751 , H04Q11/00
Abstract: 本发明公开一种骨干网络动态路径规划方法，该规划方法包含：根据光纤骨干网络构建基于光载波波长的分层网络拓扑；基于光载波波长的分层网络拓扑通过Bhandari算法得到源节点至目的节点的两条不相交的路径。本发明在路径发现过程中采用改进的Bhandari算法在基于光载波波长的分层网络中快速寻找到两条无交集的最优路径作为主路径与备份路径，有效避免因为链路失效带来的通信中断；节点根据自身的网络带宽需求和整个网络的资源占用情况计算出实时最优路径，并通过改进的算法在分层网络中快速查找两条互不相交的最优路径，为高速通信提供可靠路由保障，基于波分复用技术在计算物理路径的同时分配光纤中的光载波波长，算法效率高，反应速度快。
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公开(公告)号：CN107707266B
公开(公告)日：2020-07-31
申请号：CN201711044747.7
申请日：2017-10-31
Applicant: 上海无线电设备研究所
IPC: H04B1/00 , H04B1/04 , H04B1/7136 , H04B1/715
Abstract: 本发明公开了一种宽带高速跳频发射系统，通过软件无线电方式，在FPGA内进行数字调制、跳频频率控制和宽带射频数模转换器(DAC)控制，实现跳频带宽为5GHz，跳速为80000跳/秒的高速跳频发射系统，该系统复杂度低，稳定可靠，且体积小、成本低。
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公开(公告)号：CN107800662A
公开(公告)日：2018-03-13
申请号：CN201711268609.7
申请日：2017-12-05
Applicant: 上海无线电设备研究所
Abstract: 本发明公开了一种降低扩频OFDM信号峰值平均功率比的方法，包含：在发射端和接收端均设置基于CAZAC序列的基准序列；在所述的发射端上，将待发送数据分别以K位分组组合作为CAZAC序列的循环移位的位数，得到一系列不同循环移位的CAZAC序列，并将所述的CAZAC序列作为OFDM子载波相位数据进行映射，进行IFFT运算后变为时域信号，再通过插值滤波操作，经由DAC输出；在接收端，通过载波同步模块、位同步模块后，得到CAZAC序列的循环移位序列数据，通过本地CAZAC序列与接收到的序列进行互相关运算，根据最大值位置确定CAZAC序列的循环移位数据，从而解调出对应的K位比特数据。
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公开(公告)号：CN107800662B
公开(公告)日：2021-01-19
申请号：CN201711268609.7
申请日：2017-12-05
Applicant: 上海无线电设备研究所
Abstract: 本发明公开了一种降低扩频OFDM信号峰值平均功率比的方法，包含：在发射端和接收端均设置基于CAZAC序列的基准序列；在所述的发射端上，将待发送数据分别以K位分组组合作为CAZAC序列的循环移位的位数，得到一系列不同循环移位的CAZAC序列，并将所述的CAZAC序列作为OFDM子载波相位数据进行映射，进行IFFT运算后变为时域信号，再通过插值滤波操作，经由DAC输出；在接收端，通过载波同步模块、位同步模块后，得到CAZAC序列的循环移位序列数据，通过本地CAZAC序列与接收到的序列进行互相关运算，根据最大值位置确定CAZAC序列的循环移位数据，从而解调出对应的K位比特数据。
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公开(公告)号：CN107707266A
公开(公告)日：2018-02-16
申请号：CN201711044747.7
申请日：2017-10-31
Applicant: 上海无线电设备研究所
IPC: H04B1/00 , H04B1/04 , H04B1/7136 , H04B1/715
CPC classification number: H04B1/7136 , H04B1/0003 , H04B1/0475 , H04B1/715 , H04B2001/0491 , H04B2001/7152
Abstract: 本发明公开了一种宽带高速跳频发射系统，通过软件无线电方式，在FPGA内进行数字调制、跳频频率控制和宽带射频数模转换器(DAC)控制，实现跳频带宽为5GHz，跳速为80000跳/秒的高速跳频发射系统，该系统复杂度低，稳定可靠，且体积小、成本低。
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