神经处理单元
    1.
    发明公开
    神经处理单元 审中-公开

    公开(公告)号:CN117744724A

    公开(公告)日:2024-03-22

    申请号:CN202310997754.8

    申请日:2023-08-09

    Abstract: 公开神经处理单元。权重缓冲器被配置为以从结构化权重稀疏性布置或随机权重稀疏性布置选择的权重稀疏性布置来存储权重值。权重复用器阵列被配置为基于选择的权重稀疏性布置来输出存储在权重缓冲器中的一个或多个权重值作为第一操作数值。激活缓冲器被配置为存储激活值。激活复用器阵列结合到激活缓存器,并且被配置为输出存储在激活缓存器中的一个或多个激活值作为第二操作数值,其中,每个相应的第二操作数值和相应的第一操作数值形成操作数值对。乘法器阵列被配置为输出每个操作数值对的乘积值。

    神经处理单元
    2.
    发明公开
    神经处理单元 审中-公开

    公开(公告)号:CN117744723A

    公开(公告)日:2024-03-22

    申请号:CN202310967526.6

    申请日:2023-08-02

    Abstract: 提供神经处理单元。所述神经处理单元可被重新配置为处理从N:M=1:4、2:4、2:8和4:8细粒度结构化权重稀疏性布置选择的细粒度结构化权重稀疏性布置。权重缓冲器存储权重值,并且权重复用器阵列基于选择的细粒度结构化权重稀疏性布置来输出存储在权重缓冲器中的一个或多个权重值作为第一操作数值。激活缓冲器存储激活值,并且激活复用器阵列基于选择的细粒度结构化权重稀疏性布置输出存储在激活缓冲器中的一个或多个激活值作为第二操作数值,其中,每个相应的第二操作数值和相应的第一操作数值形成操作数值对。乘法器阵列输出每个操作数值对的乘积值。

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