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公开(公告)号：CN111950216B
公开(公告)日：2023-07-21
申请号：CN202010709748.4
申请日：2020-07-22
Applicant: 中国科学院计算技术研究所
IPC: G06F30/337 , G06F30/396 , G06F111/06
Abstract: 提供一种生成多扇出信号的方法、计算机可读存储介质和电子设备，其中N是扇出信号的数量，N个扇出信号的每一个与从信号源点到信号端点所经过的由SPL构成的分支路径相对应，所述由SPL构成的分支路径构成SPL树，该方法包括：根据N计算最少的SPL的数量Y；根据最少的SPL的数量Y选择不同的树结构；根据树结构确定多扇出信号的由SPL构成的分支路径；其中最少的SPL的数量Y根据以下公式计算：以及，所述SPL中，至多有一个SPL2，其余均为SPL3。
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公开(公告)号：CN114760241B
公开(公告)日：2023-06-02
申请号：CN202210461301.9
申请日：2022-04-28
Applicant: 中国科学院计算技术研究所
IPC: H04L45/16 , H04L45/74 , H04L47/6275 , H04L41/12
Abstract: 本发明提供了一种用于数据流架构的计算设备中的路由方法，计算设备包括多个处理单元和多个路由节点，每个处理单元直接连接一个路由节点并且被关联为该路由节点对应的本地处理单元，多个路由节点之间相互连接，方法包括：在每个路由节点，获取各方向发往本地处理单元的数据并为其中每个方向发来的数据分别维护相应的缓存队列，缓存队列为阻塞队列；在每个路由节点，确定各方向发往本地处理单元的数据对应的缓存队列中处于队列头部的数据包的供数优先级，以及根据供数优先级选择将多个队列中的一个队列的头部的数据包发送给本地处理单元，供数优先级与本地处理单元中需要该头部数据包中操作数的指令距离转为就绪状态还需到达的操作数个数相关。
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公开(公告)号：CN113313247B
公开(公告)日：2023-04-07
申请号：CN202110161624.1
申请日：2021-02-05
Applicant: 中国科学院计算技术研究所
IPC: G06N3/082
Abstract: 本发明提供了一种基于数据流架构的稀疏神经网络的运算方法，包括：依据数据流处理器的结构将稀疏神经网络的运算任务从低到高依次划分为子任务、任务和应用三个运算层级；确定所述运算层级中每个所述任务包含的所述子任务的个数、每个所述应用包含的所述任务的个数以及所述应用的个数，其中所述稀疏神经网络的输入图像数据和权重数据至少之一是稀疏矩阵；依据所述运算层级以及各个运算层级的个数，将所述稀疏神经网络的输入图像数据或权重数据划分为若干数据块；以及基于所述运算层级以及每个运算层级对应的数据块完成所述稀疏神经网络的运算任务。
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公开(公告)号：CN115694832A
公开(公告)日：2023-02-03
申请号：CN202211247649.4
申请日：2022-10-12
Applicant: 中国科学院计算技术研究所
Abstract: 提供一种基于RO PUF的密钥生成方法，所述RO PUF包括N个环形振荡器，该方法包括：步骤20)：随机生成用于选择第一个环形振荡器和第二个环形振荡器的挑战，确定所述第一个环形振荡器在第一时间长度内的振荡次数和所述第二个环形振荡器在第一时间长度内的振荡次数的差的绝对值大于第一阈值；步骤30)：利用所述挑战按照第一预定次数重复计数所述第一个环形振荡器在第一时间长度内的振荡次数，以及所述第二个环形振荡器在第一时间长度内的振荡次数，并执行第一预定次数的比较，判断所述第一预定次数的比较结果是否相同；以及步骤40)：在所述第一预定次数的比较结果都相同时，输出所述挑战和相应的比较结果。
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公开(公告)号：CN115358184A
公开(公告)日：2022-11-18
申请号：CN202211005508.1
申请日：2022-08-22
Applicant: 中国科学院计算技术研究所
IPC: G06F30/398 , G06F30/394 , G06F30/347 , G06F115/02
Abstract: 本发明提供一种基于增量编译的FPGA原型验证方法和系统，该方法包括：获取当前芯片设计并将其划分为多个分区；将当前芯片设计与前一次芯片设计进行比较，得到当前芯片设计中发生变化的分区和未发生变化的分区；对发生变化的分区进行综合，得到发生变化的分区的当前网表，将发生变化的分区的当前网表与未发生变化的分区的前一次网表进行合并，得到当前芯片设计的网表；将当前芯片设计的网表映射到FPGA芯片上，得到当前布局布线设计；以及，对当前布局布线设计进行检验，若不满足则修改芯片设计并重复上述过程，若满足则根据当前布局布线设计进行下板调试。本发明提高了FPGA原型验证的效率，并且提高了芯片的开发速度。
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Patent Agency Ranking
公开(公告)号：CN115115862A
公开(公告)日：2022-09-27
申请号：CN202210553500.2
申请日：2022-05-20
Applicant: 中国科学院计算技术研究所
IPC: G06V10/762 , G06V10/764 , G06V10/774 , G06V10/82 , G06N3/04 , G06N3/08
Abstract: 本发明提出一种基于异构图神经网络的高阶关系知识蒸馏方法和系统，所述方法主要包括一阶节点级知识蒸馏和二阶关系级知识蒸馏两部分，有效解决了数据标签不精确和异构高阶关系语义建模困难这两个问题。具体来说，该方法通过进行节点级知识蒸馏，对预训练异构教师模型的单个节点语义进行编码；通过进行关系级知识蒸馏，对预训练异构教师模型的不同类型节点之间的语义关系进行建模。通过整合节点级知识蒸馏和系级知识蒸馏,这种高阶关系知识蒸馏方法成为一种实用且通用的训练方法，适用于任意的异构图神经网络，不仅提升了异构学生模型的性能和泛化能力，而且保证了对异构图神经网络的节点级和关系级知识提取。
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公开(公告)号：CN114968873A
公开(公告)日：2022-08-30
申请号：CN202210514890.2
申请日：2022-05-11
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供一种PCIE数据交换装置，包括：至少两路PCIE的交换结构，每路交换结构至少设有用于连接相应主机的上行通道、上行接口以及用于连接扩展设备的下行通道、下行接口；多个选通开关部件，其设于每路交换结构的至少部分下行通道上以及至少部分上行通道上，用于切换扩展设备的数据传输所经由的交换结构；通路控制部件，被配置为根据每路交换结构的工作状态确定选通开关部件选通的通路，以在其中一路交换结构处于故障状态时将其对应的扩展设备转由处于正常状态的其他交换结构连接至对应的主机；本发明可以在保障业务的连续性、系统的可靠性的情况下，同时提高资源利用率。
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公开(公告)号：CN114968861A
公开(公告)日：2022-08-30
申请号：CN202210579507.1
申请日：2022-05-25
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供了一种两写两读的数据传输结构以及片上多通道交互网络，所述数据传输结构包括：两条传输通道，其中，每条传输通道包括依次连接的具有两个输入接口的仲裁器、先进先出队列和读接口，以及连接仲裁器和读接口的直通线路；两个写接口，所述写接口用于与数据输入通道连接接收输入数据，每个写接口连接到两条传输通道中的每个仲裁器的一个输入接口；其中，所述传输通道被配置为：在一个时钟周期，能同时允许两个写接口各自输入一个数据，并通过传输通道对数据进行缓存或者传输。
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公开(公告)号：CN114742642A
公开(公告)日：2022-07-12
申请号：CN202210437977.4
申请日：2022-04-20
Applicant: 中国科学院计算技术研究所
Abstract: 本发明实施例提供了一种用于资金网络的图数据处理方法，包括：获取与所述资金网络相关的图数据，其中，所述图数据包括节点和边，其中节点表示用户，边表示资金流向以及资金数额；根据图数据中的每条边构建与之方向相反的虚边；获取图数据的源节点以及用于限定所需资金环路要求的约束参数，从源节点开始根据图数据中的边和约束参数进行正向遍历以及根据图数据中的虚边和约束参数进行反向遍历；基于正向遍历和反向遍历的结果，确定图数据中存在的资金环路；本发明可以高效地确定图数据满足所需资金环路要求的资金环路。进而基于确定的资金环路对资金网络中的风险，如洗钱、信用卡诈骗等，进行把控。
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公开(公告)号：CN114721824A
公开(公告)日：2022-07-08
申请号：CN202210358585.9
申请日：2022-04-06
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供了一种资源分配方法、介质以及电子设备，方法包括：获取应用需要容器化的请求，请求至少包括应用的访存特征声明以及所需的硬件资源声明；响应于请求，根据应用所需的硬件资源声明、访存特征声明以及所有工作节点的可用资源分布信息，确定资源调度策略，访存特征声明至少用于指示应用所需的硬件资源由工作节点中的单个NUMA节点还是多个NUMA节点提供，可用资源分布信息包括工作节点上各个NUMA节点自身的资源剩余量的指示；根据资源调度策略将应用的访存特征声明以及所需的硬件资源声明发送给相应的工作节点，以调度应用所需的硬件资源。本发明在考虑应用访存特征的情况下确定资源调度策略，提高资源利用率和/或容器的工作效率。
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