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公开(公告)号：CN102136842A
公开(公告)日：2011-07-27
申请号：CN201010571034.8
申请日：2010-12-02
Applicant: 华为技术有限公司
IPC: H03M13/11
Abstract: 本发明实施例公开了一种译码器及译码方法，涉及译码领域，能够较大程度的提高译码器的吞吐量。本发明的译码器包括：R个层运算模块和硬判决输出模块；所述R个层运算模块依次连接，在任意相邻的两个层运算模块中，前一个层运算模块的输出是后一个层运算模块的输入；第N个层运算模块以预定码字长度为并行位宽并行接收待译码数据对应的APP值，对接收的APP值进行更新运算，得到所述待译码数据对应的经过该层运算模块更新运算后的APP值，并将更新运算后的APP值以预定码字长度为并行位宽并行输出；硬判决输出模块接收第R个层运算模块输出的APP值并将其进行硬判决输出。本发明实施例主要用于高吞吐量译码的过程中。
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公开(公告)号：CN101001112A
公开(公告)日：2007-07-18
申请号：CN200610063774.4
申请日：2006-12-31
Applicant: 华为技术有限公司
Abstract: 本发明提供了一种利用光纤传送数据信号的方法、装置和系统，该方法包括，在发送端将时钟频率插在复用后的数据信号中形成混合信号，并通过光纤发送到接收端；在接收端对接收到的混合信号进行滤波，获得时钟频率；将该时钟频率倍频到副载波频率，利用该副载波频率恢复需要传送的数据信号。本发明将时钟频率与复用后的数据信号混合发送，使得接收端只需一个滤波器，且将混合信号中的时钟频率滤出变得容易实现而且简单：导频信号的频率低，信号旁边因而没有干扰。从而使得xDSL信号可以通过光纤传送在接收端被正确恢复；解决了进行多路xDSL信号复用\解复用时的副载波频率的同频同相问题。
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公开(公告)号：CN114793145B
公开(公告)日：2024-04-23
申请号：CN202110105094.9
申请日：2021-01-26
Applicant: 华为技术有限公司
Abstract: 本发明实施例公开了一种解码方法、接收设备以及存储介质，其用于降低对信号帧进行解码的时延，有效地提高对信号帧进行解码的准确性。所述方法包括：接收设备对信号帧进行至少一次初始码间串扰ISI更新以获取多个初始ISI参数，所述初始ISI参数与第一符号的软信息对应，所述第一符号为所述信号帧所对应的任一符号；所述接收设备根据所述多个初始ISI参数进行M次ISI更新，所述M为大于1的正整数；所述接收设备根据所述多个初始ISI参数进行N次前向纠错码FEC更新，所述N为大于1的正整数。
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公开(公告)号：CN116261066A
公开(公告)日：2023-06-13
申请号：CN202111508860.2
申请日：2021-12-10
Applicant: 华为技术有限公司
Abstract: 本申请实施例公开了一种数据传输方法及相关设备，应用于无源光网络。该数据传输方法具体包括：通过在一种FEC的基础上级联另一种FEC的方法增强性能，并将另一种FEC产生的额外的码字开销插入数据的空闲帧中，不影响当前现网设备，从而实现兼容已有的FEC情况下，提升FEC增益性能，提升网络功率预算和接收机灵敏度。
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公开(公告)号：CN106537787B
公开(公告)日：2019-10-22
申请号：CN201480080748.5
申请日：2014-07-31
Applicant: 华为技术有限公司
IPC: H03M13/05
Abstract: 本发明实施例提供一种译码方法和译码器。包括：在对多个码字进行至少一次软判决译码后，判断软判决译码的译码结果是否满足切换为硬判决译码的切换条件，若不满足所述切换条件则在下一次译码时继续采用软判决译码，若满足所述切换条件则在下一次译码时切换为硬判决译码，并在后续的译码过程中一直使用硬判决译码直至跳出译码迭代。从而，能够在软判决译码的译码结果达到一定条件时，切换为功耗较小的硬判决译码，避免持续使用功耗较大的软判决译码，从而在能够实现在不损失译码性能的前提下降低译码器的功耗。
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Patent Agency Ranking
公开(公告)号：CN105191305A
公开(公告)日：2015-12-23
申请号：CN201480000611.4
申请日：2014-04-01
Applicant: 华为技术有限公司
IPC: H04N19/10
CPC classification number: H04L1/0041 , H03M13/1111 , H03M13/1515 , H03M13/152 , H03M13/2906 , H04L1/0003 , H04L1/0045 , H04L1/0058 , H04L1/007 , H04N1/00
Abstract: 本发明实施例提供了一种自适应调制编码的方法、装置及系统，涉及通信领域，用于提高系统升级的灵活性。所述方法，包括：获取待处理数据；获取与待处理数据对应的信道信息，并根据信道信息确定调制模式；根据调制模式从待处理数据中确定出第一数据及第二数据；对第一数据进行软判决前向纠错FEC编码得到第一比特流；根据第二数据，获取第二比特流；根据星座映射规则，将第一比特流与第二比特流进行调制；发送调制后的数据。本发明实施例适用于移动通信中处理数据的场景。
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公开(公告)号：CN102687445B
公开(公告)日：2015-01-21
申请号：CN201180004322.8
申请日：2011-12-30
Applicant: 华为技术有限公司
IPC: H04L1/00
CPC classification number: H03M13/116 , H03M13/036 , H03M13/1154 , H03M13/333 , H03M13/63
Abstract: 本发明公开了一种前向纠错编、解码方法、装置及系统，属于通信领域。方法包括：根据传输系统性能、复杂度及码字同步对齐方式确定时变周期LDPC卷积码的校验矩阵参数，并根据确定的校验矩阵参数构造QC-LDPC校验矩阵，并根据QC-LDPC校验矩阵得到时变周期LDPC卷积码的校验矩阵HC；将待编码数据按照HC的要求进行分块，并根据HC对每个分块数据进行编码，得到多个LDPC卷积码码字；将多个LDPC卷积码码字添加在数据帧中发送。本发明通过采用具有QC-LDPC结构的时变周期LDPC卷积码进行前向纠错，由于QC-LDPC的校验特性可降低校验的复杂度，且LDPC卷积码的性能优于LDPC分组码，而时变LDPC卷积码的性能又优于时不变LDPC卷积码，因此，可以适用于高速光传输系统，满足高增益性能和高吞吐量的要求。
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公开(公告)号：CN102394843B
公开(公告)日：2014-09-03
申请号：CN201110182164.7
申请日：2011-06-30
Applicant: 华为技术有限公司
CPC classification number: H04L1/005 , H04L25/067
Abstract: 本发明公开了一种纠错及反馈均衡控制方法和装置，所述方法预存训练序列的初始值，通过训练序列得到第一PDF和BERin；再计算第二PDF；由第一PDF和第二PDF得到第三PDF；由本次接收的有效数据的软信息、第三PDF得到该有效数据的软信息的LLR分布；由第三PDF反映的跳周情况与信道噪声畸变程度和BERin调整均衡算法中的系数；利用LLR分布和BERin对本次接收的有效数据的软信息进行纠错硬判并输出。通过训练序列得到BERin和第一PDF，结合第二PDF得到能体现跳周情况和信道噪声畸变程度的第三PDF，对均衡算法系数的调整更有针对性，译码性能改善明显。
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公开(公告)号：CN102142928B
公开(公告)日：2013-11-06
申请号：CN201010553896.8
申请日：2010-11-19
Applicant: 华为技术有限公司
IPC: H04L1/00
Abstract: 本发明提供一种交织外码编码输出码字的方法，根据外码编码输出码的码字阵列，获得行数为外码编码输出码的个数、列数为外码编码输出码的码长的第一矩阵，将第一矩阵划分成至少四个子矩阵，根据至少四个子矩阵中的至少两个子矩阵进行列向量转置组合，获得内码编码的输入码字。本发明还提供一种解交织外码编码输出码字的方法、一种交织器和一种解交织器。采用本发明的交织、解交织外码编码输出码字的方法和交织、解交织器，对外码编码与内码编码进行并行交织级联，从而将内码译码的随机错误和/或较长突发错误均匀地分布在外码编码输出码字内，降低了级联码的差错平层。
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公开(公告)号：CN103190107A
公开(公告)日：2013-07-03
申请号：CN201180002527.2
申请日：2011-10-31
Applicant: 华为技术有限公司
IPC: H04L1/00
CPC classification number: H04L1/0042 , H04J3/0608 , H04J3/1652 , H04L1/0041 , H04L1/0045 , H04L1/0047 , H04L1/0057 , H04L25/0226
Abstract: 本发明实施例提供了数据发送器、数据接收器和帧同步方法。数据发送器包括编码模块和处理模块，其中，编码模块，用于对发送数据进行前向纠错FEC编码得到FEC码字，并向处理模块输出FEC码字和用于指示FEC码字的边界位置的指示信号；处理模块，用于根据指示信号在FEC码字中插入训练序列，以便数据接收器根据训练序列确定FEC码字的边界位置。数据接收器包括处理模块和译码模块。根据上述技术方案，通过利用原本会插入到FEC码字中的训练序列来帮助进行帧同步，不会增加系统开销，从而不会提高系统线路速率，并由于训练序列使用效率的提高，可以改善系统性能。
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