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公开(公告)号：CN105138870A
公开(公告)日：2015-12-09
申请号：CN201510644519.8
申请日：2015-10-08
Applicant: 浪潮(北京)电子信息产业有限公司
Inventor： 童元满
Abstract: 本发明实施例公开了一种芯片合法性鉴别方法及装置，包括：终端获取随机数，对所述随机数进行第一次加密，得出第一密文，并将所述随机数和所述第一密文发送给被鉴芯片；所述被鉴芯片对所述随机数进行第二次加密得出第二密文，并判断所述第二密文与所述第一密文是否相同，若相同，则对所述随机数进行第三次加密所得到第三密文，并将所述第三密文发送给所述终端；所述终端对所述随机数进行第四次加密，得出第四密文；所述终端判断所述第四密文是否与所述第三密文相同；若相同，则所述被鉴芯片为合法芯片。本实施例通过这种双向鉴别机制可以有效避免非法的鉴别请求，确保只有合法的芯片鉴别方才能够对芯片进行鉴别，以确保芯片鉴别时的安全性。
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公开(公告)号：CN105005645A
公开(公告)日：2015-10-28
申请号：CN201510373574.8
申请日：2015-06-30
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F17/50
Abstract: 本发明公开了一种覆盖率的统计方法及装置，所述方法包括：在代码中分别为代码中的每个待覆盖点添加用于检测待覆盖点的覆盖情况的检测逻辑以及用于保存检测结果的寄存器；在代码开始执行后，检测逻辑检测对应的待覆盖点的覆盖情况，在检测到对应的待覆盖点被覆盖时，记录到对应的寄存器中，直到代码执行完毕；分别读取每个待覆盖点对应的寄存器的寄存器值，对读取的寄存器值进行统计分析，生成代码的覆盖结果。本发明在保证芯片的结构和功能实现的前提下，添加的检测逻辑和寄存器使覆盖率的统计，不再依赖于代码版本的稳定，对代码版本的变动不再敏感，可以灵活的应用于代码设计的初期和中期阶段，使验证工作尽早地高效开展。
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公开(公告)号：CN104363141A
公开(公告)日：2015-02-18
申请号：CN201410687270.4
申请日：2014-11-25
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: H04L12/26
Abstract: 本发明公开一种基于处理器系统的现场可编程门阵列(FPGA)验证方法及系统。上述方法包括以下步骤：监控模块根据配置的待监控的协议特征字，监控特征协议的处理情况，若监控到所述特征协议的处理发生错误时，所述监控模块锁定出现错误的处理器的当前状态，在向量表中标记出现错误的处理器对应的向量位置，并发送错误报告信息至接口模块；所述接口模块根据接收的所述错误报告信息，获取并输出出现错误的处理器的协议处理内容以供分析。本发明公开的基于处理器系统的FPGA验证方法及系统，能够解决现有技术中处理器系统的FPGA验证难以有效调试及定位故障的问题。
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公开(公告)号：CN104331352A
公开(公告)日：2015-02-04
申请号：CN201410663826.6
申请日：2014-11-19
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F11/22
Abstract: 本发明提供一种高速缓存(cache)一致性芯片地址带外读取检测方法及系统。上述方法包括以下步骤：配置读取模块将配置信息传送至逻辑检测存储模块；所述逻辑检测存储模块根据所述配置信息记录报文信息；当一致性问题发生时，所述配置读取模块从所述逻辑检测存储模块读取所述报文信息。本发明提供的cache一致性芯片地址带外读取检测方法及装置，具有配置灵活、存储资源占用量少、可读性强、操作方便的特点。
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公开(公告)号：CN104123253A
公开(公告)日：2014-10-29
申请号：CN201410363753.9
申请日：2014-07-28
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F13/28
Abstract: 本发明公开了一种实现待验证芯片互联的方法和装置，包括根据芯片间通信的信息的格式，分析通过PLI接口获得的多个信号中的信息，得到分析结果；根据预先设定的配置信息，在通过PLI接口获得的多个信号中注入延时和错误，并通过PLI接口发送经注入处理后的信号；根据分析结果和注入延时和错误的相关信息，生成日志信息。通过本发明提供的技术方案，有效提高了分析芯片间信号的能力、以及在芯片间信号中注入延时和错误的能力，从而提高了多芯片系统的验证的效率和效果，很好地满足多芯片系统验证中实现待验证芯片互联的需求。
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Patent Agency Ranking
公开(公告)号：CN111857599A
公开(公告)日：2020-10-30
申请号：CN202010746836.1
申请日：2020-07-29
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F3/06
Abstract: 本申请公开了一种数据读写方法，包括：在向目标存储器发送CMD7命令后，向目标存储器发送查询状态命令；接收目标存储器根据查询状态命令反馈的当前状态信息；根据当前状态信息确定出是否向目标存储器发送目标读写命令，以便目标存储器根据目标读写命令进行数据读写操作。本方法能避免在目标存储器不能响应读写命令时仍向目标存储器发送读写命令导致目标存储器处理出错的情况，提高目标存储器在进行数据读写操作时的准确度和可靠度。本申请还公开了一种数据读写装置、设备及计算机可读存储介质，均具有上述有益效果。
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公开(公告)号：CN111740818A
公开(公告)日：2020-10-02
申请号：CN202010589312.6
申请日：2020-06-24
Applicant: 浪潮(北京)电子信息产业有限公司
Abstract: 本申请公开了一种数据处理方法、装置、设备及存储介质。该方法的步骤包括：生成目标密钥；获取待加密数据以及待解密数据；利用同一目标密钥以并行方式对待加密数据进行加密运算和对待解密数据进行解密运算。由于本方法中，目标密钥分别用于加密运算以及解密运算，相当于在加密运算以及解密运算的整体过程中，对目标密钥进行了复用，进而相对确保了加密运算以及解密运算的整体效率以及运算资源开销。此外，本申请还提供一种数据处理装置、设备及存储介质，有益效果同上所述。
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公开(公告)号：CN105759928B
公开(公告)日：2019-05-10
申请号：CN201610077604.5
申请日：2016-02-03
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F1/24
Abstract: 本申请公开了一种应用于高速协议处理器芯片的上电复位电路，包括：电源端和复位控制电路；复位控制电路包括电压检测模块和复位控制模块；其中，电压检测模块，用于实时监测电源端的电源电压；复位控制模块，用于当电源电压小于或等于第一电压阈值，则启动复位动作，当电源电压大于或等于第二电压阈值，则终止复位动作。可见，本申请通过根据检测电源端的电源电压，并将该电源电压与第一电压阈值、第二电压阈值进行比较，并利用比较结果来控制启动复位或终止复位，由于该上电复位电路不依赖片外电容，所以在快速掉电和上电过程中具有非常好的复位效果以及二次复位效果，提高了复位可靠性。
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公开(公告)号：CN105045729B
公开(公告)日：2018-11-23
申请号：CN201510567913.6
申请日：2015-09-08
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F12/0866 , H04L29/08
Abstract: 本发明公开了一种远端代理带目录的缓存一致性处理方法与系统，令远端代理获取本地请求源发起的本地请求并进行处理，当收到来自所述远端代理的响应报文和数据时，将所述响应报文和数据返回所述本地请求源，并将对应的目录和数据分别写入目录缓存与数据缓存，判断是否有与所述远端代理的地址相同的其他目标请求，如果有则依次处理所述目标请求，从本地请求发送到远端代理占据一项目录和数据缓存开始，至该笔请求的响应报文返回，在远端代理内部缓存资源失效为止的时间内，若有其它满足一定条件下同地址请求或侦听报文进入远端代理，该笔请求可以在远端代理内部直接处理，减少报文流转快速得到响应，无需跨节点操作，减小开销。
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公开(公告)号：CN104331352B
公开(公告)日：2018-03-09
申请号：CN201410663826.6
申请日：2014-11-19
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F11/22
Abstract: 本发明提供一种高速缓存(cache)一致性芯片地址带外读取检测方法及系统。上述方法包括以下步骤：配置读取模块将配置信息传送至逻辑检测存储模块；所述逻辑检测存储模块根据所述配置信息记录报文信息；当一致性问题发生时，所述配置读取模块从所述逻辑检测存储模块读取所述报文信息。本发明提供的cache一致性芯片地址带外读取检测方法及装置，具有配置灵活、存储资源占用量少、可读性强、操作方便的特点。
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