一种碳化硅MOSFET器件及其元胞结构

    公开(公告)号:CN112786587B

    公开(公告)日:2022-09-09

    申请号:CN201911089113.2

    申请日:2019-11-08

    Abstract: 本发明公开了一种碳化硅MOSFET器件的元胞结构,包括:位于第一导电类型衬底上方的第一导电类型漂移区;在第一导电类型漂移区表面设置主沟槽,并在主沟槽的底部和侧壁设置肖特基金属,在第一导电类型漂移区表面内且于主沟槽周边设置第二导电类型阱区,于阱区表面内设置源区,源区之上设置源极金属,分裂为两部分的栅极绝缘层和栅极设置在源区、阱区及第一导电类型漂移区的靠近主沟槽一侧。本发明通过在碳化硅MOSFET器件的元胞内集成SBD,有效抑制了MOSFET器件体内PIN二极管的开启,改善了双极注入效应,提高了MOSFET器件长期使用的可靠性;同时把肖特基金属和源极金属进行有效设置,使模块封装时无需额外封装SBD,降低了封装成本,减少了杂散电感。

    一种分裂栅沟槽功率半导体器件

    公开(公告)号:CN112786695A

    公开(公告)日:2021-05-11

    申请号:CN201911089118.5

    申请日:2019-11-08

    Abstract: 本发明公开了一种分裂栅沟槽功率半导体器件,包括设置在半导体衬底上的有源区,有源区包括沿半导体衬底表面向半导体衬底底部方向纵向叠置的第一阱区和第二阱区;一个或多个通过刻蚀而成的穿透第一阱区和第二阱区的真栅沟槽,真栅沟槽中设置有分裂式多晶硅真栅,其包括分别靠近沟槽的顶部和底部分离设置的多晶硅主真栅和多晶硅辅真栅,所述多晶硅主真栅为用于与外部栅极驱动电路相连的控制栅,多晶硅主真栅与多晶硅辅真栅之间,多晶硅真栅与真栅沟槽的侧壁以及与真栅沟槽的底部之间通过层间介质隔离。本发明通过对条形沟槽内多晶硅栅进行分裂形成分裂栅,减小了寄生电容,进而采用不同电连接和设置氧化层厚度,以实现芯片性能的总体优化。

    一种具有过压保护功能的晶闸管及制造方法

    公开(公告)号:CN111599859A

    公开(公告)日:2020-08-28

    申请号:CN201910130201.6

    申请日:2019-02-21

    Abstract: 本发明公开了一种具有过压保护功能的晶闸管及制造方法,晶闸管包括:依次设置的由第一导电类型半导体材料制成的第一导电层、由第二导电类型半导体材料制成的衬底层和由第一导电类型半导体材料制成的第二导电层;在第一导电层的远离衬底层的一面上设置的阳极金属电极;在第二导电层内间隔设置的由第二导电类型半导体材料制成的发射极区;及在第二导电层上对应发射极区分别设置的浮空金属电极和阴极金属电极,衬底层向第二导电层的方向延伸将第二导电层分隔成两个第二导电区,两个第二导电区内均设置发射极区;两个第二导电区均包括基部和沿基部朝向另一第二导电区延伸的延伸部。本发明的结构简单,能够与IGBT模块并联后保护IGBT模块不被过电压损坏。

    一种母排端子及IGBT功率模块

    公开(公告)号:CN112750803B

    公开(公告)日:2023-05-16

    申请号:CN201911053070.2

    申请日:2019-10-31

    Abstract: 本申请提供了一种母排端子,应用于大功率IGBT模块,所述母排端子包括发射极母排和集电极母排,所述发射极母排和所述集电极母排均包括一主体部和设置在所述主体部底部的引脚,所述引脚包括与所述主体部连接的管脚踝部,及与所述管脚踝部连接的末端部,所述管脚踝部和所述末端部位于不同平面。本申请的母排端子能够更好地与衬板进行连接。不但能释放超声焊接工艺中所产生的机械应力以及后续大电流工况下的热电耦合应力,还能消减洛伦兹力在端部的电磁扭矩。

    一种碳化硅MOSFET器件的元胞结构及功率半导体器件

    公开(公告)号:CN112786680B

    公开(公告)日:2022-09-09

    申请号:CN201911090164.7

    申请日:2019-11-08

    Abstract: 本发明公开了一种碳化硅MOSFET元胞结构及功率半导体器件,包括:第一导电类型衬底层;位于第一导电类型衬底层上方的第一导电类型漂移区;在第一导电类型漂移区上方依次设置第一导电类型阻挡层、第二导电类型阱区和第一导电类型增强源区,其中第一导电类型阻挡层浓度大于第一导电类型漂移区的浓度;在第一导电类型漂移区表面还设置有源极金属和肖特基金属,并分别形成欧姆接触和肖特基接触;本发明通过在碳化硅MOSFET元胞内集成SBD,使模块封装时无需额外封装SBD,降低了封装成本,减少了键合线的寄生电感。同时通过在MOSFET元胞中第二导电类型阱区与第一导电类型漂移区的PN结附近漂移区侧设置有高浓度的第一导电类型阻挡层,有效的抑制第二导电类型阱区载流子向第一导电类型漂移区的注入,改善了碳化硅双极退化现象,并提高了器件的可靠性。

    一种分裂栅沟槽功率半导体器件

    公开(公告)号:CN112786695B

    公开(公告)日:2022-05-03

    申请号:CN201911089118.5

    申请日:2019-11-08

    Abstract: 本发明公开了一种分裂栅沟槽功率半导体器件,包括设置在半导体衬底上的有源区,有源区包括沿半导体衬底表面向半导体衬底底部方向纵向叠置的第一阱区和第二阱区;一个或多个通过刻蚀而成的穿透第一阱区和第二阱区的真栅沟槽,真栅沟槽中设置有分裂式多晶硅真栅,其包括分别靠近沟槽的顶部和底部分离设置的多晶硅主真栅和多晶硅辅真栅,所述多晶硅主真栅为用于与外部栅极驱动电路相连的控制栅,多晶硅主真栅与多晶硅辅真栅之间,多晶硅真栅与真栅沟槽的侧壁以及与真栅沟槽的底部之间通过层间介质隔离。本发明通过对条形沟槽内多晶硅栅进行分裂形成分裂栅,减小了寄生电容,进而采用不同电连接和设置氧化层厚度,以实现芯片性能的总体优化。

    一种碳化硅MOSFET器件的元胞结构及功率半导体器件

    公开(公告)号:CN112786680A

    公开(公告)日:2021-05-11

    申请号:CN201911090164.7

    申请日:2019-11-08

    Abstract: 本发明公开了一种碳化硅MOSFET元胞结构及功率半导体器件,包括:第一导电类型衬底层;位于第一导电类型衬底层上方的第一导电类型漂移区;在第一导电类型漂移区上方依次设置第一导电类型阻挡层、第二导电类型阱区和第一导电类型增强源区,其中第一导电类型阻挡层浓度大于第一导电类型漂移区的浓度;在第一导电类型漂移区表面还设置有源极金属和肖特基金属,并分别形成欧姆接触和肖特基接触;本发明通过在碳化硅MOSFET元胞内集成SBD,使模块封装时无需额外封装SBD,降低了封装成本,减少了键合线的寄生电感。同时通过在MOSFET元胞中第二导电类型阱区与第一导电类型漂移区的PN结附近漂移区侧设置有高浓度的第一导电类型阻挡层,有效的抑制第二导电类型阱区载流子向第一导电类型漂移区的注入,改善了碳化硅双极退化现象,并提高了器件的可靠性。

    一种碳化硅MOSFET器件及其元胞结构

    公开(公告)号:CN112786587A

    公开(公告)日:2021-05-11

    申请号:CN201911089113.2

    申请日:2019-11-08

    Abstract: 本发明公开了一种碳化硅MOSFET器件的元胞结构,包括:位于第一导电类型衬底上方的第一导电类型漂移区;在第一导电类型漂移区表面设置主沟槽,并在主沟槽的底部和侧壁设置肖特基金属,在第一导电类型漂移区表面内且于主沟槽周边设置第二导电类型阱区,于阱区表面内设置源区,源区之上设置源极金属,分裂为两部分的栅极绝缘层和栅极设置在源区、阱区及第一导电类型漂移区的靠近主沟槽一侧。本发明通过在碳化硅MOSFET器件的元胞内集成SBD,有效抑制了MOSFET器件体内PIN二极管的开启,改善了双极注入效应,提高了MOSFET器件长期使用的可靠性;同时把肖特基金属和源极金属进行有效设置,使模块封装时无需额外封装SBD,降低了封装成本,减少了杂散电感。

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