一种像素单元电路、像素阵列、面板及面板驱动方法

    公开(公告)号:CN102646386B

    公开(公告)日:2014-08-06

    申请号:CN201110124714.X

    申请日:2011-05-13

    Abstract: 本发明公开了一种像素单元电路,用于实现对TFT的阈值电压非均匀性、OLED非均匀性及IR Drop的补偿,同时提高开口率。所述像素单元电路包括:预冲电路、补偿电路、保持电路、驱动电路、发光电路、第一电源端子、第二电源端子、第三电源端子、扫描控制端、第一控制端及第二控制端;其中,预冲电路的输入端与第一电源端子相连,第一输出端与保持电路的输入端相连,第二输出端与补偿电路的输入端及驱动电路的控制端相连,控制端与扫描控制端相连;补偿电路的输出端与驱动电路的输出端及发光电路的输入端相连,控制端与第二控制端相连;保持电路的输出端与驱动电路的输入端及第二电源端子相连,控制端与第一控制端相连。

    像素电路及其驱动方法和像素阵列结构

    公开(公告)号:CN103310730A

    公开(公告)日:2013-09-18

    申请号:CN201310224463.1

    申请日:2013-06-06

    CPC classification number: G09G3/3233 G09G2300/043 G09G2300/0819

    Abstract: 本发明公开了一种像素电路及驱动方法、像素阵列结构,用以减小OLED像素电路的充电时间。本发明实施例提供的一种像素电路,包括:负载控制模块、负载模块、灰阶选择模块、驱动模块和发光元件,负载控制模块受控于第一扫描信号线,将数据信号存储在第一节点和第二节点;负载模块分别连接第一电源端子、驱动模块、第一节点和第二节点,受控于第一节点信号和第二节点信号,将模拟数据信号存储在该负载模块,并向驱动模块提供模拟数据信号;灰阶选择模块受控于第二扫描信号线,将数字数据信号传输给位于灰阶选择模块的第三节点;驱动模块受控于第二节点信号和第三节点信号,驱动发光元件;发光元件的第一端连接第二电源端子,第二端连接驱动模块。

    一种静电释放保护电路及包括该电路的显示装置

    公开(公告)号:CN102651366B

    公开(公告)日:2013-06-12

    申请号:CN201210008976.4

    申请日:2012-01-12

    CPC classification number: H01L27/0266 G09G3/20 G09G2330/02 G09G2330/04

    Abstract: 本发明公开了一种静电释放保护电路及包括该保护电路的显示装置,该电路包括都为耗尽型薄膜晶体管的第一薄膜晶体管和第二薄膜晶体管;第一薄膜晶体管的栅极与第二电平线连接,漏极与第一电平线连接,源极与信号线连接;第二薄膜晶体管的栅极与第一电平线连接,漏极与第二电平线连接,源极与信号线连接。正常工作时,本电路可以有效避免信号线释放大量电流,保证显示装置内部阵列正常工作;在静电产生时,能迅速释放信号线上积累的静电荷,保证显示装置内部阵列免受静电伤害。本发明可以利用低成本的耗尽型薄膜晶体管实现静电释放,降低静电释放保护电路的生产成本,从而降低包括该保护电路的显示装置的生产成本。

    一种静电释放保护电路及其工作方法

    公开(公告)号:CN102655145A

    公开(公告)日:2012-09-05

    申请号:CN201210009307.9

    申请日:2012-01-12

    Inventor: 段立业 吴仲远

    Abstract: 本发明提供了一种静电释放保护电路及其工作方法,涉及显示领域,为迅速泄放静电电荷同时避免信号以漏电流形式泄放而发明。所述电路包括第一电容、第一分压单元和薄膜晶体管:第一薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管;所述第一薄膜晶体管的栅极接于信号控制线,漏极接于第一电位线;所述第一分压单元的第一端接于所述第一薄膜晶体管的源极,第二端接于第二电位线;所述第三薄膜晶体管的栅极接于所述第一薄膜晶体管的源极,漏极接于第一电位线,源极接于信号控制线;所述第四薄膜晶体管栅极接于辅助电位线,漏极接于信号控制线,源极接于第二电位线;所述第一电容的第一极接于所述第三薄膜晶体管的栅极,第二极接于信号控制线。

    一种静电释放保护电路及包括该电路的显示装置

    公开(公告)号:CN102651366A

    公开(公告)日:2012-08-29

    申请号:CN201210008976.4

    申请日:2012-01-12

    CPC classification number: H01L27/0266 G09G3/20 G09G2330/02 G09G2330/04

    Abstract: 本发明公开了一种静电释放保护电路及包括该保护电路的显示装置,该电路包括都为耗尽型薄膜晶体管的第一薄膜晶体管和第二薄膜晶体管;第一薄膜晶体管的栅极与第二电平线连接,漏极与第一电平线连接,源极与信号线连接;第二薄膜晶体管的栅极与第一电平线连接,漏极与第二电平线连接,源极与信号线连接。正常工作时,本电路可以有效避免信号线释放大量电流,保证显示装置内部阵列正常工作;在静电产生时,能迅速释放信号线上积累的静电荷,保证显示装置内部阵列免受静电伤害。本发明可以利用低成本的耗尽型薄膜晶体管实现静电释放,降低静电释放保护电路的生产成本,从而降低包括该保护电路的显示装置的生产成本。

    移位寄存器及行扫描驱动电路

    公开(公告)号:CN102646387A

    公开(公告)日:2012-08-22

    申请号:CN201110130441.X

    申请日:2011-05-19

    Inventor: 段立业 吴仲远

    CPC classification number: G09G3/3233 G09G2310/0286

    Abstract: 本发明提供一种移位寄存器,包括第一薄膜晶体管、作为求值晶体管的第二薄膜晶体管、第四薄膜晶体管、作为复位晶体管的第五薄膜晶体管、第一电容和复位电压控制单元,其中,复位电压控制单元用于对第五薄膜晶体管的栅极电压进行控制,以使得当第一时钟信号输入端输入信号为低电平、第二时钟信号输入端输入信号为高电平、信号输入端输入信号为高电平时将第五薄膜晶体管的栅极电压拉低至与低电压信号输入端输入的电压相当的低电平。相应地,提供一种采用该移位寄存器的行扫描驱动电路。本发明所提供的移位寄存器的阈值电压损失小,可使复位晶体管在复位阶段提供足够大的电流,从而使得该移位寄存器甚至在高阈值电压的TFT制程中也可正常工作。

    移位寄存器单元、栅极驱动电路和显示装置

    公开(公告)号:CN102479477A

    公开(公告)日:2012-05-30

    申请号:CN201010569110.1

    申请日:2010-11-26

    Inventor: 吴仲远 段立业

    CPC classification number: G09G3/20 G09G2310/0267 G09G2310/0286

    Abstract: 本发明公开了一种移位寄存器单元、栅极驱动电路和显示装置。移位寄存器单元包括:输入模块,用于输入第一时钟信号、第二时钟信号、帧起始信号、高电压信号和低电压信号;处理模块,与输入模块相连,包括多个薄膜晶体管,用于根据第一时钟信号、第二时钟信号和帧起始信号生成栅极驱动信号,并控制薄膜晶体管形成的第一节点在移位寄存器单元的求值阶段的电压低于电源信号的低电平,控制薄膜晶体管形成的第二节点复位,以及时切断由高电压信号的输入端、低电压信号的输入端和至少一个薄膜晶体管形成的瞬态直流通路;输出模块,与处理模块相连,用于将处理模块生成的栅极驱动信号发送出去。本发明降低了瞬态电流,降低了移位寄存器单元的功耗。

    移位寄存器单元、栅极驱动电路和显示装置

    公开(公告)号:CN102479476A

    公开(公告)日:2012-05-30

    申请号:CN201010569063.0

    申请日:2010-11-26

    Inventor: 吴仲远 段立业

    Abstract: 本发明公开了一种移位寄存器单元、栅极驱动电路和显示装置。移位寄存器单元包括:输入模块,用于输入第一时钟信号、第二时钟信号、帧起始信号、高电压信号和低电压信号;其中,在一个帧时间间隔内,第一时钟信号与第二时钟信号的反相信号相同;处理模块,与输入模块相连,包括多个薄膜晶体管,用于根据第一时钟信号、第二时钟信号和帧起始信号生成栅极驱动信号,并控制多个薄膜晶体管形成的第一节点和第二节点之间构成电压变化的正反馈,以及时切断由高电压信号的输入端、低电压信号的输入端和至少一个薄膜晶体管形成的瞬态直流通路;输出模块用于将处理模块生成的栅极驱动信号发送出去。本发明降低了瞬态电流,降低了移位寄存器单元的功耗。

    显示面板及其制备方法、显示装置

    公开(公告)号:CN115917416B

    公开(公告)日:2024-10-29

    申请号:CN202180001536.3

    申请日:2021-06-15

    Abstract: 一种显示面板及其制备方法、显示装置。显示面板包括相对设置的第一基板(100)和第二基板(200),以及聚合物稳定液晶层(300);多个子像素包括至少一个从第二基板(200)远离第一基板(100)一侧出射光线的第一子像素(P1)和至少一个从第一基板(100)远离第二基板(200)一侧出射光线的第二子像素(P2);第一子像素(P1)中的第一基板(100)上设置有第一遮挡图案(51),第一子像素(P1)中的像素电极在显示面板平面上的正投影位于第一遮挡图案(51)在第一基板(100)上的正投影的范围之内;第二子像素(P2)中的第二基板(200)上设置有第二遮挡图案(52),第二子像素(P2)中的像素电极在显示面板平面上的正投影位于第二遮挡图案(52)在第二基板(200)上的正投影的范围之内。

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