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公开(公告)号:CN113366436A
公开(公告)日:2021-09-07
申请号:CN202080011427.5
申请日:2020-01-23
Applicant: 国际商业机器公司
IPC: G06F9/30
Abstract: 获得用以执行多个功能中的一个功能的指令。所述指令为符合压缩行业标准的指令集架构的单个架构化指令。执行所述指令,所述执行包括执行由所述指令指定的功能。所述执行功能包括:基于所述功能是压缩功能或解压功能,将输入数据的状态在所述输入数据的未压缩形式与所述输入数据的压缩形式之间变换,以提供变换后的数据状态。在执行所述功能期间,访问有关所述功能的历史。所述历史要被用于在未压缩形式与压缩形式之间变换输入数据的状态。
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公开(公告)号:CN107111483B
公开(公告)日:2021-04-02
申请号:CN201580058173.1
申请日:2015-10-21
Applicant: 国际商业机器公司
Abstract: 原子指令(包括“比较并交换寄存器”、“加载且与寄存器”及“加载且或寄存器”指令)使用寄存器代替存储器,以在多线程处理器中传送且共享信息。所述寄存器可由所述多线程处理器的多个线程存取,且所述指令在这些共享寄存器上操作。由所述指令经由互锁控制对所述共享寄存器的存取。
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公开(公告)号:CN107077373B
公开(公告)日:2020-09-29
申请号:CN201580056502.9
申请日:2015-09-14
Applicant: 国际商业机器公司
Inventor: L·海勒 , F·Y·布萨巴 , J·D·布拉德伯里 , M·法雷尔 , D·格雷纳 , J·P·库巴拉 , D·L·奥西塞克 , T·什莱格尔 , D·W·施密特 , C·小盖尼
Abstract: 一种在计算机处理器核心上执行包括第一线程和一组剩余线程的多个线程的系统及方法。所述系统和方法包括:确定存在开始解释执行退出条件;确定所述计算机处理器核心在宽限期内;以及所述第一线程进入开始解释执行退出同步循环而不用信号通知所述一组剩余线程中的任一者。转而,所述第一线程保持处于所述开始解释执行退出同步循环,直至所述宽限期到期或者所述剩余线程中的每一者进入对应的开始解释执行退出同步循环。
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公开(公告)号:CN106133686B
公开(公告)日:2019-08-06
申请号:CN201580013732.7
申请日:2015-03-11
Applicant: 国际商业机器公司
Abstract: 提供一种条件指令结束工具,其允许延迟指令的完成。在执行机器指令中,获得操作数,并且判定所述操作数是否与值具有预定关系。基于判定所述操作数与所述值没有所述预定关系,重复所述获得和所述判定。基于判定所述操作数与所述值具有所述预定关系,完成所述指令的执行。所述获得所述操作数、所述判定所述操作数是否具有所述预定关系、所述基于判定所述操作数与所述值没有所述预定关系而重复所述获得和所述判定,以及所述基于判定所述操作数与所述值具有所述预定关系而完成所述指令的执行作为具有一个操作码的单个指令的一部分被执行。
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公开(公告)号:CN106104478B
公开(公告)日:2019-03-22
申请号:CN201580013729.5
申请日:2015-02-23
Applicant: 国际商业机器公司
Abstract: 提供一种条件事务结束(CTEND)指令,其允许以无约束事务执行模式执行的程序检查由另一个中央处理单元或输入/输出子系统修改的存储位置。基于所检查的数据,可以结束或中止事务执行,或者可以延迟用于结束/中止的决策,例如直到发生预定义事件。例如,当所述指令执行,所述处理器处于无约束事务执行模式,并且在所述指令的开始处事务嵌套深度是1时,检查所述指令的第二操作数,并且基于所检查的数据,可以结束或中止事务执行,或者可以延迟用于结束/中止的决策,例如直到发生预定义事件,例如所述第二操作数的值变成预先指定的值或者超过某一时间间隔。
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公开(公告)号:CN106133705B
公开(公告)日:2019-02-22
申请号:CN201580013621.6
申请日:2015-03-11
Applicant: 国际商业机器公司
IPC: G06F12/0815 , G06F9/30 , G06F9/38
Abstract: 各实施例涉及实施一致性协议。一个方面包括将将针对数据的请求发送至远程处理器及由处理器自所述远程处理器接收响应。所述响应具有所述远程处理器上的远程事务的事务状态。所述处理器将所述远程处理器上的所述远程事务的所述事务状态添加至本地事务干扰追踪表中。
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公开(公告)号:CN107111578A
公开(公告)日:2017-08-29
申请号:CN201580054185.7
申请日:2015-09-14
Applicant: 国际商业机器公司
Inventor: M·法雷尔 , L·海勒 , J·P·库巴拉 , D·W·施密特 , D·格雷纳 , T·什莱格尔 , F·Y·布萨巴 , D·奥西塞克 , J·D·布拉德伯里 , F·莱纳特 , B·纳兹 , C·雅各比 , C·盖尼
Abstract: 本发明提供一种实现输入/输出(I/O)中断的经修改优先级路由的系统及方法。所述系统及方法判定所述I/O中断对于核心是否为待决的,及根据对所述I/O中断为待决的判定来判定是否针对所述中断的客机线程处理启用了所述核心的多个客机线程中的任一者。此外,所述系统及方法:判定针对客机线程处理启用的所述多个客机线程中的至少一者是否处于等待状态;及根据对针对客机线程处理启用的所述多个客机线程中的所述至少一者处于所述等待状态的判定,将所述I/O中断路由至针对客机线程处理启用且处于所述等待状态的客机线程。
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公开(公告)号:CN106133680A
公开(公告)日:2016-11-16
申请号:CN201580013692.6
申请日:2015-02-23
Applicant: 国际商业机器公司
CPC classification number: G06F9/30021 , G06F9/30029 , G06F9/3005 , G06F9/30065 , G06F9/30072 , G06F9/30079 , G06F9/30087 , G06F9/3851 , G06F9/455 , G06F9/542
Abstract: 提供一种延迟工具,其中能够延迟程序执行直到发生预定义事件,例如存储位置的比较导致真条件、到达超时、使中断变成未决或者存在另一个条件。所述延迟工具包括用于延迟执行的一个或多个比较和延迟机器指令。所述一个或多个比较和延迟指令可包括32位比较和延迟(CAD)指令以及64位比较和延迟(CADG)指令。
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