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公开(公告)号：CN112036182B
公开(公告)日：2024-07-19
申请号：CN202010757468.0
申请日：2020-07-31
Applicant: 中国科学院信息工程研究所
IPC: G06F40/295 , G06F40/30 , G06F40/126 , G06N3/042 , G06N3/084
Abstract: 本发明涉及一种多角度引入属性语义的知识表示学习方法和系统。所述方法包括：对结点的属性语义进行表征，得到属性文本的嵌入式表示；将属性文本的嵌入式表示与结点的嵌入式表示及数字外部信息的嵌入式表示相结合，代入到融合数字外部信息的知识表示学习模型中；通过融合数字外部信息的知识表示学习模型得到实体和关系的嵌入式表示。其中，采用以下两种方式中的至少一种对结点的属性语义进行表征：利用词袋模型对属性的语义进行表征；将属性看作结点的描述性文本，利用自然语言处理工具对描述性文本的语义进行表征。本发明提供了两种引入属性语义的角度，对数字形式的外部数据进行了更充分的利用，并最终提高了表示学习效果。
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Patent Agency Ranking
公开(公告)号：CN110502933B
公开(公告)日：2021-07-13
申请号：CN201910604224.6
申请日：2019-07-05
Applicant: 中国科学院信息工程研究所
Abstract: 本发明涉及一种可抵抗基于flush操作的cache攻击的软硬协同计时器实现方法和系统。该系统包括初始化软件模块、硬件模块以及运行时软件模块。在初始化阶段，初始化软件模块与硬件模块之间相互协同，以测试安全范围内最高的时间分辨率，并把硬件模块中的安全低分辨率计时器调整到该时间分辨率；在运行时阶段，在出现flush操作时，可以短暂降低自身分辨率，而当没有flush操作时，恢复自身的高分辨率。通过这种flush操作和计时器分辨率的协同机制，可以有效的抵御基于flush操作的cache攻击。同时，本发明通过优化设计，保证了高安全性的同时，其自身的性能损失非常低，因此是一种高效、安全的计时器实现方法。
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公开(公告)号：CN112036182A
公开(公告)日：2020-12-04
申请号：CN202010757468.0
申请日：2020-07-31
Applicant: 中国科学院信息工程研究所
IPC: G06F40/295 , G06F40/30 , G06F40/126 , G06N3/04 , G06N3/08
Abstract: 本发明涉及一种多角度引入属性语义的知识表示学习方法和系统。所述方法包括：对结点的属性语义进行表征，得到属性文本的嵌入式表示；将属性文本的嵌入式表示与结点的嵌入式表示及数字外部信息的嵌入式表示相结合，代入到融合数字外部信息的知识表示学习模型中；通过融合数字外部信息的知识表示学习模型得到实体和关系的嵌入式表示。其中，采用以下两种方式中的至少一种对结点的属性语义进行表征：利用词袋模型对属性的语义进行表征；将属性看作结点的描述性文本，利用自然语言处理工具对描述性文本的语义进行表征。本发明提供了两种引入属性语义的角度，对数字形式的外部数据进行了更充分的利用，并最终提高了表示学习效果。
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公开(公告)号：CN111898127A
公开(公告)日：2020-11-06
申请号：CN202010633770.5
申请日：2020-07-02
Applicant: 中国科学院信息工程研究所
Abstract: 本发明提出一种可抵抗基于flush操作的Spectre攻击的方法及系统，属于信息安全软硬件协同设计技术领域，可以实时监测和记录进程的flush操作，监测该进程是否进行恶意的flush行为，若是监测为恶意进程，便暂时禁用分支预测，阻止CPU进行推测执行，不仅可以抵制攻击者发起的基于flush操作的Spectre攻击，而且保证了系统的flush功能的正常使用。
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公开(公告)号：CN108650075A
公开(公告)日：2018-10-12
申请号：CN201810448155.X
申请日：2018-05-11
Applicant: 中国科学院信息工程研究所
Abstract: 本发明涉及一种抗侧信道攻击的软硬结合AES快速加密实现方法和系统。该方法包括：起始软件加密阶段，运行在全可编程SoC的ARM内核的软件程序上，指令操作的顺序被两个随机数R1和R2随机化，结束的时间点被R1随机化；硬件加密阶段，运行在全可编程SoC的FPGA上，其加密起始和结束的时间点被两个随机数R1和R2随机化；最后软件加密阶段，运行在全可编程SoC的ARM内核的软件程序上，指令操作的顺序被两个随机数R1和R2随机化，起始的时间点被R2随机化。本发明在保证高数据吞吐率的情况下，可同时抵御cache时间攻击、能量/电磁分析攻击，是一种高效、安全的AES加密方法。
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公开(公告)号：CN104200178A
公开(公告)日：2014-12-10
申请号：CN201410382777.9
申请日：2014-08-06
Applicant: 中国科学院信息工程研究所
IPC: G06F21/71
CPC classification number: G06F21/556
Abstract: 本发明公开了一种双沿触发驱动逻辑系统及抵抗能量分析攻击的方法，包括信号源、控制单元和驱动逻辑电路和驱动逻辑补偿电路，并由该系统代替标准信号源及驱动逻辑电路的方式，在提高了安全性的同时，通过控制单元产生长度为半个时钟周期的复位信号，从而把输出一组数据的两个时钟周期压缩为一个时钟周期，从而不会降低整个芯片硬件设备的工作效率。
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