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公开(公告)号:CN1536503A
公开(公告)日:2004-10-13
申请号:CN200410032525.X
申请日:2004-04-08
Applicant: 夏普株式会社
Inventor: 大山茂郎
IPC: G06F13/36 , G06F13/38 , G06F12/14 , G06K19/073
CPC classification number: G06F21/85
Abstract: 本发明的目的在于,提供能够实现存储器内部或总线上的信息不被解读的保密性高的数据处理装置及IC卡的加密电路。加密电路具有:被处理数据由2个数据块(B1)、(B0)组成,已处理数据由2个数据块(B1’)、(B0’)组成,对数据块(B1)进行第1加密处理、输出第1中间数据的第1加密单元(231);进行数据块(B0)与第1中间数据的“异或”运算,输出数据块(B1’)的第1运算单元(233);对数据块(B1’)进行第2加密处理、输出第2中间数据的第2加密单元(232)以及;进行第2中间数据与数据块(B1)的“异或”运算,输出数据块(B0’)的第2运算单元(234)。
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公开(公告)号:CN102611549B
公开(公告)日:2015-08-19
申请号:CN201210018581.2
申请日:2012-01-20
Applicant: 夏普株式会社
Inventor: 大山茂郎
CPC classification number: H04L9/0869 , G06F21/72 , H04L9/0637
Abstract: 本发明提供了一种能够在对数据加密并将其写至能够被以页为单位访问的存储设备或从其读取数据以及将其解密时执行对任意页的高速访问的数据加密设备。该设备:对数据加密并将其写至存储设备或从存储设备读取数据并通过流密码将其解密;使用块密码的计数器模式来生成伪随机数系列;通过将一页划分成具有块密码的块长度的多个页块,基于页号和页块号来指定存储设备中的数据位置;以及使用通过所述页号、页块号和任意偏移值的函数确定的值作为将在计数器模式下使用的伪随机数的初始值。
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公开(公告)号:CN101782846B
公开(公告)日:2012-08-08
申请号:CN201010002995.7
申请日:2010-01-15
Applicant: 夏普株式会社
Inventor: 大山茂郎
CPC classification number: G06F7/728
Abstract: 本发明提供一种用于蒙哥马利乘法的运算电路,其能够仅使用1端口RAM进行蒙哥马利乘法。该运算电路能够执行:从对a[s-1:0]和b[s-1:0]进行储存的同步式1端口RAM的存储器(M2)读出b[i]并储存到寄存器R1的第一读出处理;从存储器(M2)读出a[j],从对t[s-1:0]进行储存的同步式1端口RAM的存储器(M1)读出t[j],从寄存器(R1)读出b[i],从寄存器(R2)读出值RC,输入进行计算t[j]+a[j]*b[j]+RC的积和运算处理的积和运算电路10的第二读出处理;将运算结果数据(FH)写入寄存器(R2),并且将运算结果数据(FL)作为t[j]写入到存储器(M1)的写入处理,在第一读出处理执行后,执行第一子循环处理,该第一子循环处理反复执行第二读出处理、积和运算处理、写入处理。
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公开(公告)号:CN101681310B
公开(公告)日:2012-07-18
申请号:CN200880015658.2
申请日:2008-03-13
Applicant: 夏普株式会社
Inventor: 大山茂郎
CPC classification number: G06F11/1068
Abstract: 本发明提供非易失性存储器的错误检测控制系统,在某种程度确保数据的可靠性及耐篡改性、且不使错误检测处理的处理步骤及电路结构复杂,就能执行重写处理。具有:非易失性存储器(10),其具有多个地址的量的数据区域,该数据区域按1地址的每一个由主数据区域和冗余数据区域构成;存储器控制单元(20),对非易失性存储器(10)进行如下处理的控制,即以数据区域组为单位的一并擦除处理、以数据区域为单位的读出处理、以数据区域为单位的写入处理及以位为单位的重写处理;错误检测单元(30),基于对应的冗余数据对读出数据执行错误检测处理;错误检测控制单元(50),基于以是否是重写处理的执行对象分类的数据类别或表示是否执行了重写处理的存储状态,控制可否执行错误检测处理。
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公开(公告)号:CN101782846A
公开(公告)日:2010-07-21
申请号:CN201010002995.7
申请日:2010-01-15
Applicant: 夏普株式会社
Inventor: 大山茂郎
CPC classification number: G06F7/728
Abstract: 本发明提供一种用于蒙哥马利乘法的运算电路,其能够仅使用1端口RAM进行蒙哥马利乘法。该运算电路能够执行:从对a[s-1:0]和b[s-1:0]进行储存的同步式1端口RAM的存储器(M2)读出b[i]并储存到寄存器R1的第一读出处理;从存储器(M2)读出a[j],从对t[s-1:0]进行储存的同步式1端口RAM的存储器(M1)读出t[j],从寄存器(R1)读出b[i],从寄存器(R2)读出值RC,输入进行计算t[j]+a[j]*b[j]+RC的积和运算处理的积和运算电路10的第二读出处理;将运算结果数据(FH)写入寄存器(R2),并且将运算结果数据(FL)作为t[j]写入到存储器(M1)的写入处理,在第一读出处理执行后,执行第一子循环处理,该第一子循环处理反复执行第二读出处理、积和运算处理、写入处理。
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公开(公告)号:CN1460965A
公开(公告)日:2003-12-10
申请号:CN03136495.0
申请日:2003-05-22
Applicant: 夏普株式会社
Inventor: 大山茂郎
IPC: G06K19/067
CPC classification number: G06K19/07769 , G06K19/07
Abstract: 一种组合型IC卡,包含通过设置在卡上的接触型通信用端子用于读写数据的接触型接口、利用天线线圈接收通过无线传送来的数据用于读写数据的由非接触型通信用并联共振电路构成的非接触型接口两者。包含利用从接触型通信端子之一的时钟端子输入的接触型通信用时钟的频率和由天线线圈接收的非接触型通信用时钟的频率之间的差异,进行是接触型通信或者非接触型通信的哪一种通信的判定的接触/非接触判定电路。这样,可以提供能高精度、稳定进行是接触型通信或者非接触型通信的哪一种通信的判定的组合型IC卡。
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