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公开(公告)号：CN111934953B
公开(公告)日：2024-02-02
申请号：CN202010786548.9
申请日：2020-08-07
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于国产处理器计算机平台的批量测试方法，其中，包括：根据MAC地址列表，修改/etc/dhcp下的dhcp配置文件，在配置文件中指定MAC与ip的对应关系，删除/var/lib/dhcp下的租约，重启dhcp服务；将服务器和多台待测计算机连接到同一台交换机，通过dhcp自动为待测机分配ip；以服务器时间为基准，同步待测计算机的系统时间；通过scp协议将测试程序客户端推送到每台待测机的/opt路径下并解压，推送完成后，通过ssh协议执行解压目录下的start.sh，该脚本通过crontab计划任务启动测试程序客户端；在服务端的web页面发起全局、单项以及多项测试请求，客户端会根据请求依次调用tools路径下的测试脚本进行测试。(56)对比文件王晓彬;廖建新;王纯;刘争;朱晓民.移动智能网业务自动化测试系统的研究与实现.计算机工程.2008,(第01期),全文.刘量等.通用服务器端软件测试框架的研究与实现《.计算机工程与应用》.2006,(第28期),全文.谭浩等.性能测试的原理及其自动化工具的实现《.计算机工程与设计》.2006,(第19期),全文.
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公开(公告)号：CN111930312B
公开(公告)日：2023-10-20
申请号：CN202010804112.8
申请日：2020-08-12
Applicant: 北京计算机技术及应用研究所
IPC: G06F3/06
Abstract: 本发明涉及一种双控存储阵列异步逻辑单元访问方法，属于计算机存储技术领域。本发明提供的异步逻辑单元访问方式，两个控制器可各自访问不同的逻辑单元实现双控双活。两个控制器不需要通过通信协商对同一个逻辑单元的访问控制，而是通过目标端口的配置，将主机负载均衡分配在两个控制器上，是一种“带外”的控制方式。这种异步逻辑单元访问方式较同步逻辑单元访问方式可显著降低控制器间通信开销，显著提升逻辑单元访问效率，提高逻辑单元的访问性能。
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Patent Agency Ranking
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公开(公告)号：CN109032934B
公开(公告)日：2021-07-02
申请号：CN201810749749.4
申请日：2018-07-10
Applicant: 北京计算机技术及应用研究所
IPC: G06F11/36
Abstract: 本发明涉及一种FPGA/IP核逻辑代码安全规则检测方法，涉及FPGA/IP核验证技术领域。本发明根据所设计的自定义安全规则检测条款和现有商业条款相结合，在自定义安全规则检测条款增加并实现了FPGA状态机死锁、内部三态等规则条款，提高了FPGA代码的质量；删减根本不适用于FPGA的可测试性设计的规则、电气特性检测等规则，有效的降低了无效警示规则条款。
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公开(公告)号：CN112905389A
公开(公告)日：2021-06-04
申请号：CN202110318149.4
申请日：2021-03-25
Applicant: 北京计算机技术及应用研究所
IPC: G06F11/14
Abstract: 本发明涉及一种飞腾服务器平台下开机恢复和关机保存的方法，其中，关机数据保存软件处理流程如下：步骤A1：操作系统收到关机操作指令或者重启操作指令后，操作系统在关机通过systemctl调用关机数据保存应用程序，该应用程序是根据该发明，定制化设计开发的；步骤A2：关机数据保存应用程序首先打开内存条的设备文件节点，判断是否打开成功，成功则进入步骤A3，不成功则进入步骤A5；步骤A3：关机数据保存应用程序打开NVMe电子盘设备文件节点，判断是否打开成功，成功则进入步骤A4，不成功则进入步骤A5；步骤A4：关机数据保存应用程序开始将数据从普通内存条拷贝到NVMe电子盘中，完成则进入步骤A5，没有完成则继续开始新的数据的拷贝；步骤A5：结束关机数据保存应用程序；以及开机数据恢复软件处理。
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公开(公告)号：CN111934953A
公开(公告)日：2020-11-13
申请号：CN202010786548.9
申请日：2020-08-07
Applicant: 北京计算机技术及应用研究所
IPC: H04L12/26
Abstract: 本发明涉及一种基于国产处理器计算机平台的批量测试方法，其中，包括：根据MAC地址列表，修改/etc/dhcp下的dhcp配置文件，在配置文件中指定MAC与ip的对应关系，删除/var/lib/dhcp下的租约，重启dhcp服务；将服务器和多台待测计算机连接到同一台交换机，通过dhcp自动为待测机分配ip；以服务器时间为基准，同步待测计算机的系统时间；通过scp协议将测试程序客户端推送到每台待测机的/opt路径下并解压，推送完成后，通过ssh协议执行解压目录下的start.sh，该脚本通过crontab计划任务启动测试程序客户端；在服务端的web页面发起全局、单项以及多项测试请求，客户端会根据请求依次调用tools路径下的测试脚本进行测试。
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公开(公告)号：CN109032934A
公开(公告)日：2018-12-18
申请号：CN201810749749.4
申请日：2018-07-10
Applicant: 北京计算机技术及应用研究所
IPC: G06F11/36
CPC classification number: G06F11/3604
Abstract: 本发明涉及一种FPGA/IP核逻辑代码安全规则检测方法，涉及FPGA/IP核验证技术领域。本发明根据所设计的自定义安全规则检测条款和现有商业条款相结合，在自定义安全规则检测条款增加并实现了FPGA状态机死锁、内部三态等规则条款，提高了FPGA代码的质量；删减根本不适用于FPGA的可测试性设计的规则、电气特性检测等规则，有效的降低了无效警示规则条款。
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