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公开(公告)号：CN117579040A
公开(公告)日：2024-02-20
申请号：CN202311598798.X
申请日：2023-11-27
Applicant: 复旦大学
Abstract: 本发明属于集成电路技术领域，具体为基于延迟线环路与注入锁定振荡器的多相位时钟信号生成器。本发明多相位时钟信号生成器包括：包括单转差的缓冲器、延迟线环路以及M个互相耦合的环形振荡器；通过单转差缓冲器将输入单相位时钟信号分为差分时钟信号，差分时钟信号送入延迟线环路，将输入的差分时钟信号分为N相位时钟信号，N相位时钟信号作为注入信号送入M个互相耦合的环形振荡器中，通过注入锁定使得M个振荡器锁定在同一频率下，再通过M个环形振荡器之间的互相耦合，约束出NхM相位的输出信号；本发明能够最大限度的降低相位噪声与相位误差，并且产生倍于延迟线环路输出的时钟相位。
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