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公开(公告)号：CN117521734A
公开(公告)日：2024-02-06
申请号：CN202311462442.3
申请日：2023-11-06
Applicant: 南京大学
IPC: G06N3/0464 , G06F7/523
Abstract: 本发明提供了一种用于实现高能效乘法运算的存内计算电路，包括存内Booth编码器阵列和存内计算阵列，存内计算阵列包括存内部分积生成器；存内部分积生成器存储被乘数，利用数据锁存单元中两个互补的锁存节点代表被乘数和被乘数的相反数，用临近数据锁存单元的两个互补锁存节点代表被乘数的两倍和被乘数的两倍的相反数，不增加额外的晶体管开销即可实现取反和移位，产生基4Booth算法所有可能的非零部分积，乘数信号控制存内Booth编码器阵列产生编码信号，编码信号控制数据选择器选出四种非零部分积中的一种。本发明适用于任意位宽乘法运算，提升了数据锁存单元电路的利用率和存算一体单元电路的对称性，能灵活调整计算并行度。
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