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公开(公告)号：CN102083196A
公开(公告)日：2011-06-01
申请号：CN201010566410.4
申请日：2010-11-26
Applicant: 三星电子株式会社
IPC: H04W56/00
CPC classification number: G06F13/405
Abstract: 本发明示例实施例涉及带宽同步电路和带宽同步方法。带宽同步电路包括扩大器和同步降低单元。扩大器包括根据第一时钟操作的同步打包器和同步解包器。同步降低单元连接到扩大器，并且响应于频率低于第一时钟频率的第二时钟，对扩大器的数据执行同步降低操作。
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Patent Agency Ranking
公开(公告)号：CN102083196B
公开(公告)日：2015-07-08
申请号：CN201010566410.4
申请日：2010-11-26
Applicant: 三星电子株式会社
IPC: H04W56/00
CPC classification number: G06F13/405
Abstract: 本发明示例实施例涉及带宽同步电路和带宽同步方法。带宽同步电路包括扩大器和同步降低单元。扩大器包括根据第一时钟操作的同步打包器和同步解包器。同步降低单元连接到扩大器，并且响应于频率低于第一时钟频率的第二时钟，对扩大器的数据执行同步降低操作。
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公开(公告)号：CN102103561B
公开(公告)日：2015-04-01
申请号：CN201010573018.2
申请日：2010-12-01
Applicant: 三星电子株式会社
IPC: G06F13/36
CPC classification number: G06F13/4059
Abstract: 一种数据处理系统中的异步扩展电路。所述异步扩展电路包括异步打包器和异步解包器。所述异步打包器包括：写缓冲器，共同地用于异步桥以及用于扩展和缓冲写通道数据；以及第一和第二异步打包控制器，用于关于在突发写操作期间输入到写缓冲器/从写缓冲器输出的写通道数据，分别根据第一和第二时钟来控制通道压缩。所述异步解包器包括：读缓冲器，共同地用于异步桥以及用于扩展和缓冲读通道数据；以及第一和第二异步解包控制器，用于关于在突发读操作期间输入到读缓冲器/从读缓冲器输出的读通道数据，分别根据第一和第二时钟来控制通道压缩。
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公开(公告)号：CN103970710A
公开(公告)日：2014-08-06
申请号：CN201310346570.1
申请日：2013-08-09
Applicant: 三星电子株式会社
IPC: G06F15/17
CPC classification number: G06F15/80 , G06F15/7807
Abstract: 一种片上系统（SOC）包括：从设备、多个主设备、互连设备和多个服务控制器。所述主设备产生要求来自所述从设备的服务的请求。所述互连设备通过各自通道耦合到所述从设备和所述主设备，并且所述互连设备对所述请求执行仲裁操作。所述服务控制器依据SOC的操作环境改变而自适应地控制来自所述主设备的请求流。
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公开(公告)号：CN102103561A
公开(公告)日：2011-06-22
申请号：CN201010573018.2
申请日：2010-12-01
Applicant: 三星电子株式会社
IPC: G06F13/36
CPC classification number: G06F13/4059
Abstract: 一种数据处理系统中的异步扩展电路。所述异步扩展电路包括异步打包器和异步解包器。所述异步打包器包括：写缓冲器，共同地用于异步桥以及用于扩展和缓冲写通道数据；以及第一和第二异步打包控制器，用于关于在突发写操作期间输入到写缓冲器/从写缓冲器输出的写通道数据，分别根据第一和第二时钟来控制通道压缩。所述异步解包器包括：读缓冲器，共同地用于异步桥以及用于扩展和缓冲读通道数据；以及第一和第二异步解包控制器，用于关于在突发读操作期间输入到读缓冲器/从读缓冲器输出的读通道数据，分别根据第一和第二时钟来控制通道压缩。
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